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電子發(fā)燒友網(wǎng)>模擬技術(shù)>Maxim推出高性能、三路輸出時鐘發(fā)生器MAX3625B

Maxim推出高性能、三路輸出時鐘發(fā)生器MAX3625B

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2018-11-15 16:38:263910

AD9523時鐘發(fā)生器性能特點及應(yīng)用分析

AD9523:14路LVPECL/LVDS/HSTL輸出 或29路LVCMOS輸出 低抖動時鐘發(fā)生器
2019-07-04 06:18:003604

LMK033x8時鐘發(fā)生器的主要特性和優(yōu)勢

TI推出超低抖動時鐘發(fā)生器,以實現(xiàn)更可靠的電信基礎(chǔ)設(shè)施設(shè)備,設(shè)計人員可以優(yōu)化系統(tǒng)性能,簡化設(shè)備配置并減少設(shè)計周期時間。
2019-08-09 15:10:281653

如何選擇合適的時鐘發(fā)生器

系統(tǒng)設(shè)計師通常側(cè)重于為應(yīng)用選擇最合適的數(shù)據(jù)轉(zhuǎn)換器,在向數(shù)據(jù)轉(zhuǎn)換器提供輸入的時鐘發(fā)生器件的選擇上往往少有考慮。然而,如果不慎重考慮時鐘發(fā)生器的相位噪聲和抖動性能,數(shù)據(jù)轉(zhuǎn)換器動態(tài)范圍和線性度性能可能受到嚴(yán)重的影響。
2020-11-22 11:34:382666

AD9520-0:12路LVPECL/24路CMOS輸出時鐘發(fā)生器,集成2.8 GHz VCO

AD9520-0:12路LVPECL/24路CMOS輸出時鐘發(fā)生器,集成2.8 GHz VCO
2021-03-19 09:02:270

AD9523-1:低抖動時鐘發(fā)生器,14路LVPECL/LVDS/HSTL輸出或29路LVCMOS輸出 數(shù)據(jù)手冊

AD9523-1:低抖動時鐘發(fā)生器,14路LVPECL/LVDS/HSTL輸出或29路LVCMOS輸出 數(shù)據(jù)手冊
2021-03-21 14:28:081

AD9525: 8路LVPECL輸出低抖動時鐘發(fā)生器

AD9525: 8路LVPECL輸出低抖動時鐘發(fā)生器
2021-03-21 15:00:200

AD9518-1:6輸出時鐘發(fā)生器,集成2.5 GHz壓控振蕩器數(shù)據(jù)表

AD9518-1:6輸出時鐘發(fā)生器,集成2.5 GHz壓控振蕩器數(shù)據(jù)表
2021-03-22 19:55:031

AD9518-3:6輸出時鐘發(fā)生器,集成2.0 GHz壓控振蕩器數(shù)據(jù)表

AD9518-3:6輸出時鐘發(fā)生器,集成2.0 GHz壓控振蕩器數(shù)據(jù)表
2021-04-13 11:13:252

AD9517-2:12輸出時鐘發(fā)生器,集成2.2 GHz壓控振蕩器數(shù)據(jù)表

AD9517-2:12輸出時鐘發(fā)生器,集成2.2 GHz壓控振蕩器數(shù)據(jù)表
2021-04-13 11:57:480

AD9517-1:12輸出時鐘發(fā)生器,集成2.5 GHz壓控振蕩器數(shù)據(jù)表

AD9517-1:12輸出時鐘發(fā)生器,集成2.5 GHz壓控振蕩器數(shù)據(jù)表
2021-04-13 12:02:551

AD9517-0:12輸出時鐘發(fā)生器,集成2.8 GHz壓控振蕩器數(shù)據(jù)表

AD9517-0:12輸出時鐘發(fā)生器,集成2.8 GHz壓控振蕩器數(shù)據(jù)表
2021-04-13 12:10:210

AD9571:以太網(wǎng)時鐘發(fā)生器,10個時鐘輸出

AD9571:以太網(wǎng)時鐘發(fā)生器,10個時鐘輸出
2021-04-16 10:21:563

AD9522-1:12 LVDS/24 CMOS輸出時鐘發(fā)生器,集成2.4 GHz壓控振蕩器數(shù)據(jù)表

AD9522-1:12 LVDS/24 CMOS輸出時鐘發(fā)生器,集成2.4 GHz壓控振蕩器數(shù)據(jù)表
2021-04-16 20:21:521

AD9520-5:12 LVPECL/24 CMOS輸出時鐘發(fā)生器數(shù)據(jù)表

AD9520-5:12 LVPECL/24 CMOS輸出時鐘發(fā)生器數(shù)據(jù)表
2021-04-27 21:31:552

AD9516-5:14-輸出時鐘發(fā)生器數(shù)據(jù)表

AD9516-5:14-輸出時鐘發(fā)生器數(shù)據(jù)表
2021-04-27 21:41:195

AD9551:多業(yè)務(wù)時鐘發(fā)生器數(shù)據(jù)表

AD9551:多業(yè)務(wù)時鐘發(fā)生器數(shù)據(jù)表
2021-04-28 10:30:520

AD9522-5:12 LVDS/24 CMOS輸出時鐘發(fā)生器數(shù)據(jù)表

AD9522-5:12 LVDS/24 CMOS輸出時鐘發(fā)生器數(shù)據(jù)表
2021-04-28 10:53:010

AD9522-4:12集成1.6 GHz壓控振蕩器數(shù)據(jù)表的LVDS/24 CMOS輸出時鐘發(fā)生器

AD9522-4:12集成1.6 GHz壓控振蕩器數(shù)據(jù)表的LVDS/24 CMOS輸出時鐘發(fā)生器
2021-04-29 19:06:061

AN-1576:采用AD9958 500 MSPS DDS或AD9858 1 GSPS DDS和AD9515時鐘分配IC的高性能ADC的低抖動采樣時鐘發(fā)生器

AN-1576:采用AD9958 500 MSPS DDS或AD9858 1 GSPS DDS和AD9515時鐘分配IC的高性能ADC的低抖動采樣時鐘發(fā)生器
2021-04-30 09:48:4213

AD9517-4:12輸出時鐘發(fā)生器,集成1.6 GHz壓控振蕩器數(shù)據(jù)表

AD9517-4:12輸出時鐘發(fā)生器,集成1.6 GHz壓控振蕩器數(shù)據(jù)表
2021-04-30 15:51:4210

AD9573:PCI-Express時鐘發(fā)生器IC,PLL內(nèi)核,分頻器,雙輸出數(shù)據(jù)表

AD9573:PCI-Express時鐘發(fā)生器IC,PLL內(nèi)核,分頻器,雙輸出數(shù)據(jù)表
2021-05-08 20:05:055

AD9575:網(wǎng)絡(luò)時鐘發(fā)生器,雙輸出數(shù)據(jù)表

AD9575:網(wǎng)絡(luò)時鐘發(fā)生器,雙輸出數(shù)據(jù)表
2021-05-09 11:06:441

AD9531:3通道時鐘發(fā)生器,24輸出數(shù)據(jù)表

AD9531:3通道時鐘發(fā)生器,24輸出數(shù)據(jù)表
2021-05-15 15:24:0711

AD9516-3:14輸出時鐘發(fā)生器,集成2.0 GHz壓控振蕩器數(shù)據(jù)表

AD9516-3:14輸出時鐘發(fā)生器,集成2.0 GHz壓控振蕩器數(shù)據(jù)表
2021-05-25 12:00:102

AD9517-0 12輸出時鐘發(fā)生器,集成2.8 GHz壓控振蕩器數(shù)據(jù)表

AD9517-0 12輸出時鐘發(fā)生器,集成2.8 GHz壓控振蕩器數(shù)據(jù)表
2021-06-16 12:14:494

集成2.2 GHz壓控振蕩器數(shù)據(jù)表的AD9517-2 12輸出時鐘發(fā)生器

集成2.2 GHz壓控振蕩器數(shù)據(jù)表的AD9517-2 12輸出時鐘發(fā)生器
2021-06-17 12:31:303

集成2.0 GHz壓控振蕩器數(shù)據(jù)表的AD9518-3 6輸出時鐘發(fā)生器

集成2.0 GHz壓控振蕩器數(shù)據(jù)表的AD9518-3 6輸出時鐘發(fā)生器
2021-06-17 15:38:273

集成2.5 GHz壓控振蕩器數(shù)據(jù)表的AD9517-1 12輸出時鐘發(fā)生器

集成2.5 GHz壓控振蕩器數(shù)據(jù)表的AD9517-1 12輸出時鐘發(fā)生器
2021-06-17 15:57:386

時鐘發(fā)生器AD9516-0技術(shù)手冊

時鐘發(fā)生器AD9516-0技術(shù)手冊
2022-01-25 15:59:427

Cypress時鐘發(fā)生器的分類,它有哪些應(yīng)用

。Cypress時鐘發(fā)生器兼容大量增值性能,如VCXO,擴頻和輸出相位校準(zhǔn),及其兼容流行接口標(biāo)準(zhǔn)的參考時鐘/3.0,如PCIe1.0/2.0/3.0、10GbE、SATA1.0/2.0和USB1.0
2022-04-22 09:02:09806

超低抖動時鐘發(fā)生器如何優(yōu)化串行鏈路系統(tǒng)性能

超低抖動時鐘發(fā)生器如何優(yōu)化串行鏈路系統(tǒng)性能
2022-11-04 09:50:150

評估低抖動PLL時鐘發(fā)生器的電源噪聲抑制

本文討論電源噪聲干擾對基于PLL的時鐘發(fā)生器的影響,并介紹幾種用于評估由此產(chǎn)生的確定性抖動(DJ)的測量技術(shù)。派生關(guān)系顯示了如何使用頻域雜散測量來評估時序抖動行為。實驗室臺架測試結(jié)果用于比較測量技術(shù),并演示如何可靠地評估參考時鐘發(fā)生器的電源噪聲抑制(PSNR)性能。
2023-04-11 11:06:39811

核芯互聯(lián)高性能通用時鐘發(fā)生器CLG5908概述

CLG5908是一顆高性能的任意頻率任意輸出格式通用時鐘發(fā)生器,可以支持1~750M任意頻點輸出,頻率精度 < 0.001 PPM,并且jitter性能優(yōu)越,通常模式下RMS jitter<200fs,同時支持Down-Spread和Center-Spread SSC。
2023-04-23 14:43:12626

極景微發(fā)布超小封裝PCIe5.0時鐘發(fā)生器

極景微發(fā)布超小封裝PCIe5.0時鐘發(fā)生器日前,極景微(UltraSilicon)宣布,推出兩款支持PCIe5.0接口標(biāo)準(zhǔn)的1輸出及2輸出時鐘發(fā)生器,分別為US6D101和US6D102。該芯片具有
2023-02-02 15:25:54999

時鐘合成器和時鐘發(fā)生器的區(qū)別

時鐘合成器和時鐘發(fā)生器是兩種用于產(chǎn)生時鐘信號的電子器件,它們在功能和應(yīng)用上有一些區(qū)別。
2023-11-09 10:26:56298

時鐘發(fā)生器性能對數(shù)據(jù)轉(zhuǎn)換器的影響

時鐘發(fā)生器件的選擇上往往少有考慮。目前市場上有性能屬性大相徑庭的眾多時鐘發(fā)生器。然而,如果不慎重考慮時鐘發(fā)生器、相位噪聲和抖動性能,數(shù)據(jù)轉(zhuǎn)換器、動態(tài)范圍和線性度性能可能受到嚴(yán)重的影響。...
2023-11-28 14:33:570

核芯互聯(lián)推出支持PCIe Gen 6的時鐘發(fā)生器CLG440

“核芯互聯(lián)CLG440是一顆專為高性能服務(wù)器、計算中心應(yīng)用推出的支持PCIe 6.0、符合CK440Q標(biāo)準(zhǔn)的高性能時鐘發(fā)生器。
2024-01-16 15:57:40279

核芯互聯(lián)發(fā)布高性能時鐘發(fā)生器CLG440

核芯互聯(lián)近日發(fā)布了一款專為高性能服務(wù)器和計算中心應(yīng)用打造的支持PCIe 6.0的高性能時鐘發(fā)生器——CLG440。這款產(chǎn)品符合CK440Q標(biāo)準(zhǔn),旨在滿足下一代服務(wù)器和數(shù)據(jù)中心的需求。
2024-01-16 16:09:07446

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