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現(xiàn)代高速運(yùn)算放大器 (op amps) 的建立時間都為幾納秒左右。這個時間是如此的短暫。因此，要想在某個合理誤差范圍內(nèi)對其進(jìn)行測定，不僅僅對自動測試設(shè)備（ATE）是一個難題，即使在工作臺上也難以完成。今天的運(yùn)算放大器產(chǎn)品說明書中，常常以模擬值的形式給出產(chǎn)品的建立時間數(shù)據(jù)，原因是在工作臺上對其進(jìn)行測試需要安裝更多硬件設(shè)備，而這會增加測定的成本和難度。傳統(tǒng)的高速示波器僅有一個10比特模數(shù)轉(zhuǎn)換器，限制了測量分辨率（最大0.1%）。
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本文將介紹一種新方法，其經(jīng)過證明可以有效地完成這些測量工作。它是一種相對低成本、簡單的建立時間測量方法。這種方法把準(zhǔn)確性和精確度建立在波形生成器和采樣保持電路的相對速度上。
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受測器件的步進(jìn)輸入
本文中，建立時間是指使用某個理想步進(jìn)輸入，到受測器件（DUT）進(jìn)入并維持在某個規(guī)定誤差范圍（終值對稱）內(nèi)的時間。理想步進(jìn)輸入很容易在模擬中產(chǎn)生得到，但在實(shí)驗(yàn)室中卻沒有能夠產(chǎn)生理想步進(jìn)波形的儀器設(shè)備。即使在理想條件下，過阻尼和高阻尼儀器的輸出可能需要一些RC時間常量，以單調(diào)地穩(wěn)定在0.1%終值范圍以內(nèi)。
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對于一些欠阻尼系統(tǒng)而言，步進(jìn)波形會超出終值，并且可能會出現(xiàn)振鈴。實(shí)際上，即使是高阻尼系統(tǒng)也會有欠阻尼現(xiàn)象。一般而言，步進(jìn)波形下降越快，過沖和振鈴也就越多。之后，這種非理想狀況傳播至受測器件的測量輸出波形。幸運(yùn)的是，利用計(jì)算機(jī)日志記錄輸入和輸出數(shù)據(jù)，通過排列這兩種數(shù)據(jù)并用輸出減去輸入便可實(shí)現(xiàn)輸出標(biāo)準(zhǔn)化（受測器件使用同相單位增益配置）。
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平底脈沖生成器
波形生成器降沿用作受測器件的輸入時，可以使用一個平底脈沖生成器（FBPG）來平整生成信號的低壓電平。平底脈沖生成器將降電壓鉗制接地，代價是出現(xiàn)更大的過沖。這樣便讓測試工程師能夠通過測試裝置調(diào)節(jié)平衡實(shí)現(xiàn)一定程序的控制。同樣，我們可以使用平頂脈沖生成器來平整高壓電平。
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圖 1 顯示了兩個背靠背放置的高速齊納二極管，每個二極管都有一個單獨(dú)、可調(diào)節(jié)電源。一般原則是，按照如下順序啟動裝置：調(diào)節(jié)Rsupply，獲得D1/D2連接5V電壓，然后調(diào)節(jié)Vgenerator輸出電壓，讓其在2V高壓和-5V低壓之間擺動。這樣便可在2Vpp高壓電平和0V低壓電平下對輸出進(jìn)行偏置。當(dāng)Vgenerator為高時，D2關(guān)閉，D1開啟。在此期間，輸出電壓成為D1正向電壓（Vsupply）的函數(shù)，同時也是流經(jīng)Rsupply和D1電流量的函數(shù)。當(dāng)輸入為低時，D1關(guān)閉，D2開啟。在此期間，輸出電壓擺至接地電壓，同時其轉(zhuǎn)換速率與流入相應(yīng)電阻器R3的電流大小成正比例關(guān)系。瞬態(tài)響應(yīng)與二極管電容、反向恢復(fù)時間和正向恢復(fù)電壓有關(guān)。
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圖 1 平底脈沖生成器 (FBPG)
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由于二極管的非線性特性，需使用嚴(yán)密的方程式來計(jì)算DC電平和平底脈沖生成器瞬態(tài)響應(yīng)。作為一種替代方法，也可以在軟件（例如：德州儀器公司的TINA-TI?）中模擬這些方程式。假設(shè)脈沖生成器的速度非?？?，則輸出波形的降時間和過沖與二極管的速度和恢復(fù)時間有關(guān)，同時也與寄生電容和安裝平底脈沖生成器的印刷電路板（PCB）的電感有關(guān)。換句話說，設(shè)計(jì)人員應(yīng)該選擇最快速、最健壯的二極管，并在將平底脈沖生成器用于高速波形生成時遵循優(yōu)秀PCB布局原則。
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建立時間測量的采樣保持方法
就這里介紹的例子而言，我們選擇使用TI的OPA615（見圖2）來實(shí)現(xiàn)建立時間測量的采樣保持（S/H）功能，這是因?yàn)椋核鼡碛袑拵н\(yùn)算跨導(dǎo)放大器（OTA），針對低輸入偏置電流進(jìn)行了優(yōu)化；另外，它還擁有快速、精確的采樣OTA（SOTA），其同時起到一個比較器和緩沖器的作用。當(dāng)保持控制引腳為高時，通過SOTA在電容器（CHOLD）上對模擬輸入（VIN）采樣。當(dāng)保持控制引腳變低時，CHOLD電壓在輸出（VOUT）端得到保持和反射。采樣期間，CHOLD電壓被調(diào)節(jié)至輸入實(shí)時電壓電平。如果輸入和CHOLD之間的差異較大，并且采樣時間僅為幾納秒，則要求高轉(zhuǎn)換速率。保持期間，CHOLD電壓始終充電/放電，原因是其漏電流和OTA所需的偏置電流。電流反饋環(huán)路可確保SOTA轉(zhuǎn)換速率足以捕獲VIN的正確電壓電平。
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圖 2 采樣保持（S/H）電路
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圖3顯示了一個100kHz正弦波輸入S/H輸出的例子。我們可以使用一個波形生成器來產(chǎn)生受測器件的輸入階梯函數(shù)，并將S/H信號與該階梯函數(shù)同步。S/H電路可用于捕獲受測器件輸出波形上的各個點(diǎn)。如果有一個與輸出同步的標(biāo)記輸出，則任何任意波形生成器都有效，從而產(chǎn)生非常合適的保持控制信號。舉例測試使用一個Tektronix AWG610，其擁有2.6 Gbps的采樣時間和100 ps的最小標(biāo)記步進(jìn)，讓它適用于大多數(shù)高速運(yùn)算放大器建立時間的測量工作。
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圖 3 100kHz正弦波的舉例1MHz S/H輸出
圖4描述了如何使用一個S/H電路捕獲曲線上的各個點(diǎn)，而該S/H電路將標(biāo)記用作保持控制信號。設(shè)計(jì)人員可以通過移動標(biāo)記位置來捕獲曲線上的連續(xù)各點(diǎn)。在記錄完所有點(diǎn)以后，可將S/H曲線繪制出來進(jìn)行分析。使用MATLAB?或者LabVIEW?等軟件對波形生成器編程，以此來改變標(biāo)記和記錄結(jié)果，是一種非常簡單的方法。將標(biāo)記設(shè)定在位置1后，S/H電路追蹤標(biāo)記為高時的VIN電壓電平，并在標(biāo)記為低時保持該值。在位置1處，輸出保持在1V。在位置2處，輸出保持在0.2V。
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圖 4 AWG610輸出的標(biāo)記同步例子
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圖5顯示了建立時間測量的測試裝置，其使用AWG610和OPA615實(shí)現(xiàn)S/H功能。所有信號線路均為50Ω。波形生成器輸出用作測試信號，并使用兩個S/H電路：一個測量受測器件（OPA656）的輸入，另一個測量受測器件的輸出。數(shù)字萬用表（DMM）用于記錄各個保持值。
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本文將介紹一種新方法，其經(jīng)過證明可以有效地完成這些測量工作。它是一種相對低成本、簡單的建立時間測量方法。這種方法把準(zhǔn)確性和精確度建立在波形生成器和采樣保持電路的相對速度上。
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受測器件的步進(jìn)輸入
本文中，建立時間是指使用某個理想步進(jìn)輸入，到受測器件（DUT）進(jìn)入并維持在某個規(guī)定誤差范圍（終值對稱）內(nèi)的時間。理想步進(jìn)輸入很容易在模擬中產(chǎn)生得到，但在實(shí)驗(yàn)室中卻沒有能夠產(chǎn)生理想步進(jìn)波形的儀器設(shè)備。即使在理想條件下，過阻尼和高阻尼儀器的輸出可能需要一些RC時間常量，以單調(diào)地穩(wěn)定在0.1%終值范圍以內(nèi)。
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對于一些欠阻尼系統(tǒng)而言，步進(jìn)波形會超出終值，并且可能會出現(xiàn)振鈴。實(shí)際上，即使是高阻尼系統(tǒng)也會有欠阻尼現(xiàn)象。一般而言，步進(jìn)波形下降越快，過沖和振鈴也就越多。之后，這種非理想狀況傳播至受測器件的測量輸出波形。幸運(yùn)的是，利用計(jì)算機(jī)日志記錄輸入和輸出數(shù)據(jù)，通過排列這兩種數(shù)據(jù)并用輸出減去輸入便可實(shí)現(xiàn)輸出標(biāo)準(zhǔn)化（受測器件使用同相單位增益配置）。
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平底脈沖生成器
波形生成器降沿用作受測器件的輸入時，可以使用一個平底脈沖生成器（FBPG）來平整生成信號的低壓電平。平底脈沖生成器將降電壓鉗制接地，代價是出現(xiàn)更大的過沖。這樣便讓測試工程師能夠通過測試裝置調(diào)節(jié)平衡實(shí)現(xiàn)一定程序的控制。同樣，我們可以使用平頂脈沖生成器來平整高壓電平。
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圖 1 顯示了兩個背靠背放置的高速齊納二極管，每個二極管都有一個單獨(dú)、可調(diào)節(jié)電源。一般原則是，按照如下順序啟動裝置：調(diào)節(jié)Rsupply，獲得D1/D2連接5V電壓，然后調(diào)節(jié)Vgenerator輸出電壓，讓其在2V高壓和-5V低壓之間擺動。這樣便可在2Vpp高壓電平和0V低壓電平下對輸出進(jìn)行偏置。當(dāng)Vgenerator為高時，D2關(guān)閉，D1開啟。在此期間，輸出電壓成為D1正向電壓（Vsupply）的函數(shù)，同時也是流經(jīng)Rsupply和D1電流量的函數(shù)。當(dāng)輸入為低時，D1關(guān)閉，D2開啟。在此期間，輸出電壓擺至接地電壓，同時其轉(zhuǎn)換速率與流入相應(yīng)電阻器R3的電流大小成正比例關(guān)系。瞬態(tài)響應(yīng)與二極管電容、反向恢復(fù)時間和正向恢復(fù)電壓有關(guān)。
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圖 1 平底脈沖生成器 (FBPG)
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由于二極管的非線性特性，需使用嚴(yán)密的方程式來計(jì)算DC電平和平底脈沖生成器瞬態(tài)響應(yīng)。作為一種替代方法，也可以在軟件（例如：德州儀器公司的TINA-TI?）中模擬這些方程式。假設(shè)脈沖生成器的速度非?？?，則輸出波形的降時間和過沖與二極管的速度和恢復(fù)時間有關(guān)，同時也與寄生電容和安裝平底脈沖生成器的印刷電路板（PCB）的電感有關(guān)。換句話說，設(shè)計(jì)人員應(yīng)該選擇最快速、最健壯的二極管，并在將平底脈沖生成器用于高速波形生成時遵循優(yōu)秀PCB布局原則。
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建立時間測量的采樣保持方法
就這里介紹的例子而言，我們選擇使用TI的OPA615（見圖2）來實(shí)現(xiàn)建立時間測量的采樣保持（S/H）功能，這是因?yàn)椋核鼡碛袑拵н\(yùn)算跨導(dǎo)放大器（OTA），針對低輸入偏置電流進(jìn)行了優(yōu)化；另外，它還擁有快速、精確的采樣OTA（SOTA），其同時起到一個比較器和緩沖器的作用。當(dāng)保持控制引腳為高時，通過SOTA在電容器（CHOLD）上對模擬輸入（VIN）采樣。當(dāng)保持控制引腳變低時，CHOLD電壓在輸出（VOUT）端得到保持和反射。采樣期間，CHOLD電壓被調(diào)節(jié)至輸入實(shí)時電壓電平。如果輸入和CHOLD之間的差異較大，并且采樣時間僅為幾納秒，則要求高轉(zhuǎn)換速率。保持期間，CHOLD電壓始終充電/放電，原因是其漏電流和OTA所需的偏置電流。電流反饋環(huán)路可確保SOTA轉(zhuǎn)換速率足以捕獲VIN的正確電壓電平。
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圖 2 采樣保持（S/H）電路
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圖3顯示了一個100kHz正弦波輸入S/H輸出的例子。我們可以使用一個波形生成器來產(chǎn)生受測器件的輸入階梯函數(shù)，并將S/H信號與該階梯函數(shù)同步。S/H電路可用于捕獲受測器件輸出波形上的各個點(diǎn)。如果有一個與輸出同步的標(biāo)記輸出，則任何任意波形生成器都有效，從而產(chǎn)生非常合適的保持控制信號。舉例測試使用一個Tektronix AWG610，其擁有2.6 Gbps的采樣時間和100 ps的最小標(biāo)記步進(jìn)，讓它適用于大多數(shù)高速運(yùn)算放大器建立時間的測量工作。
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圖 3 100kHz正弦波的舉例1MHz S/H輸出
圖4描述了如何使用一個S/H電路捕獲曲線上的各個點(diǎn)，而該S/H電路將標(biāo)記用作保持控制信號。設(shè)計(jì)人員可以通過移動標(biāo)記位置來捕獲曲線上的連續(xù)各點(diǎn)。在記錄完所有點(diǎn)以后，可將S/H曲線繪制出來進(jìn)行分析。使用MATLAB?或者LabVIEW?等軟件對波形生成器編程，以此來改變標(biāo)記和記錄結(jié)果，是一種非常簡單的方法。將標(biāo)記設(shè)定在位置1后，S/H電路追蹤標(biāo)記為高時的VIN電壓電平，并在標(biāo)記為低時保持該值。在位置1處，輸出保持在1V。在位置2處，輸出保持在0.2V。
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圖 4 AWG610輸出的標(biāo)記同步例子
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圖5顯示了建立時間測量的測試裝置，其使用AWG610和OPA615實(shí)現(xiàn)S/H功能。所有信號線路均為50Ω。波形生成器輸出用作測試信號，并使用兩個S/H電路：一個測量受測器件（OPA656）的輸入，另一個測量受測器件的輸出。數(shù)字萬用表（DMM）用于記錄各個保持值。
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