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臺(tái)積電：2014年推出16nm FinFET工藝
臺(tái)積電的著眼點(diǎn)不僅在于工藝制程的縮小，同樣也聚焦在CoWoS即所謂3D IC制造上。
臺(tái)積電首席技術(shù)官兼研發(fā)副總裁孫元成在2013年4月已經(jīng)透露其官方的CMOS工藝路線圖，從2013年先進(jìn)的20nm平面SoC開始，至2014年臺(tái)積電將采用16nm節(jié)點(diǎn)的FinFET工藝制程，使用低供電電壓，從0.8V降至 0.6V，從而使超低功耗處理器如ARMv8盡可能降低功耗至750毫瓦。接下來，臺(tái)積電計(jì)劃在2015年至2016年間，通過直寫電子束或者極紫外光、EUV光刻技術(shù)將其FinFET的工藝提升至10nm節(jié)點(diǎn)，以提高35%的性能。
盡管臺(tái)積電預(yù)計(jì)它的16nm FinFET與20nm制程僅差距一個(gè)世代，于2015年時(shí)推出，而它的10nm制程于2017年導(dǎo)入量產(chǎn)，但是與英特爾不斷領(lǐng)先的工藝制程技術(shù)相比，可能仍有兩年的差距。但是臺(tái)積電在張忠謀的領(lǐng)導(dǎo)下，它的投資力度很大，而且業(yè)績(jī)節(jié)節(jié)上升，所以臺(tái)積電的龍頭地位恐暫時(shí)無人能夠撼動(dòng)。
顯然臺(tái)積電的著眼點(diǎn)不僅在于工藝制程的縮小，同樣也聚焦在CoWoS即所謂3D IC制造上，利用TSV等3D IC技術(shù)，將異質(zhì)架構(gòu)的多個(gè)芯片封裝在一體。
目前，Xilinx（賽靈思）是臺(tái)積電公布的第一代3D技術(shù)的唯一客戶。第一代3D技術(shù)也稱作2.5 D硅中介（interposer）技術(shù)，用于整合多個(gè)FPGA和其他芯片。
三星：完成14nm FinFET測(cè)試芯片流片
三星的14nm FinFET工藝設(shè)計(jì)套件已經(jīng)提供給客戶，相關(guān)產(chǎn)品設(shè)計(jì)也可開始提供，但三星并未披露會(huì)何時(shí)投入量產(chǎn)。
三星是全球DRAM與NAND閃存都居第一位的存儲(chǔ)器制造大廠，實(shí)力非凡。近年來由于移動(dòng)市場(chǎng)的興起，存儲(chǔ)器的需求已不如從前。三星要爭(zhēng)先的意識(shí)非常強(qiáng)烈，它迅速積極地轉(zhuǎn)型到邏輯工藝，并在美國奧斯汀累計(jì)投資達(dá)60億美元興建12英寸晶圓廠。由于三星電子的產(chǎn)業(yè)鏈很完整，自身生產(chǎn)終端電子產(chǎn)品包括智能手機(jī)、平板電腦、電視、冰箱等，所以它的邏輯芯片除了部分自用之外，還可將富裕的產(chǎn)能做代工服務(wù)，并首先爭(zhēng)取到蘋果的A系列處理器訂單。
2013年第一季度三星在28nm~32nm制程的12英寸晶圓月產(chǎn)能平均為22.5萬片，約占全球代工的50%，遠(yuǎn)高于臺(tái)積電的11萬片。排名第三的格羅方德為6.5萬片。
在2012全球代工廠商排名中三星以43.3億美元的業(yè)績(jī)擠下UMC（聯(lián)電）成為第三， 相比2011年增長一倍。不僅如此，它與格羅方德的銷售額差距僅為兩億美元，所以三星非常有可能在2013年代工排名中成為老二。
作為14nm FinFET工藝開發(fā)的一部分，三星聯(lián)合ARM、Cadence、Mentor、Synopsys等生態(tài)伙伴，已完成了多種測(cè)試芯片的流片工作，包括完整的ARM Cortex-A7處理器、可在接近閾值電壓下工作的SRAM芯片、模擬IP陣列等。
14nm Cortex-A7處理器的成功流片是三星14nm工藝的最關(guān)鍵性突破，也是Fabless的新希望。Cortex A7、A15是天生一對(duì)，在ARM big.LITTLE策略中分別負(fù)責(zé)低功耗、高性能，而此番在FinFET工藝上部署成功，也驗(yàn)證了ARM新平臺(tái)的未來可行性。下一步就應(yīng)該是嘗試流片Cortex-A15了。
三星表示，對(duì)比目前的32nm/28nm HKMG工藝，14nm FinFET工藝會(huì)進(jìn)一步大大改善SoC芯片的漏電率和動(dòng)態(tài)功耗。
三星的14nm FinFET工藝設(shè)計(jì)套件已經(jīng)提供給客戶，相關(guān)產(chǎn)品設(shè)計(jì)也可開始提供，但三星并未披露會(huì)何時(shí)投入量產(chǎn)。
格羅方德：14nm和10nm都將導(dǎo)入FinFET
格羅方德的10nm與14nm XM都是所謂的混合制程，10nm就是運(yùn)用14nm的設(shè)備與設(shè)計(jì)工具，制造線寬約為10nm的芯片。
格羅方德的目標(biāo)很高，技術(shù)長蘇比（SubiKengeri）認(rèn)為移動(dòng)裝置電子產(chǎn)品內(nèi)的芯片對(duì)于晶圓先進(jìn)制程的需求將會(huì)高度增長，依2011年到2016年的預(yù)測(cè)，40nm以下先進(jìn)制程的晶圓年復(fù)合成長率達(dá)37%，到2016年時(shí)產(chǎn)值在全球晶圓代工的比重將高達(dá)60%。
為了搶攻這一波移動(dòng)商機(jī)，格羅方德在2012年已經(jīng)開始準(zhǔn)備14nm XM制程，計(jì)劃于2014年量產(chǎn)，并宣布它的10nm制程將在2015年量產(chǎn)，兩種制程都將導(dǎo)入FinFET的3D工藝。
格羅方德的10nm與14nm XM都是所謂的混合制程，例如14nm就是采用20nm的設(shè)備與設(shè)計(jì)工具做出線寬14nm的芯片，10nm就是運(yùn)用14nm的設(shè)備與設(shè)計(jì)工具，制造線寬約為10nm的芯片。
相較于臺(tái)積電暫先不做14nm制程，而是推出16nm FinFET，蘇比認(rèn)為公司之所以開發(fā)14nm制程，是因?yàn)橛⑻貭柌粩噙M(jìn)軍移動(dòng)市場(chǎng)，使得臺(tái)積電公司的客戶感受到巨大的壓力。
格羅方德預(yù)計(jì)20nm制程在2013年下半年推出，與臺(tái)積電幾乎同步，公司的12英寸廠包括德國德勒斯登的晶圓一廠（Fab1）與紐約八廠（Fab8），各有4萬片與6萬片的月產(chǎn)能，其中Fab8將導(dǎo)入28nm以下最先進(jìn)制程。
格羅方德技術(shù)長蘇比近期赴中國***，宣稱兩年內(nèi)將拿下全球晶圓代工技術(shù)的龍頭地位，繼14nmXM制程于2014年量產(chǎn)之后，在2015年將開始10nm制程量產(chǎn)，這樣的進(jìn)度相比臺(tái)積電可能領(lǐng)先兩年，也幾乎與英特爾同步。
聯(lián)電：14nm FinFET工藝推出時(shí)間可能生變
對(duì)于聯(lián)電來說最大的問題是速度，其14nm FinFET工藝的推出時(shí)間可能生變。
讓業(yè)界產(chǎn)生驚奇的是，近期聯(lián)電也宣布與IBM合作，開發(fā)14nm甚至10nm工藝制程，反映在代工領(lǐng)域中幾乎沒有人掉隊(duì)。它的FinFET工藝的授權(quán)同樣來自IBM公司，因此具體做法與格羅方德應(yīng)該是相似的，都是在20nm后端工藝上采用14nm的FinFET晶體管結(jié)構(gòu)。唯一讓業(yè)界生疑的是它的FinFET工藝是采用體硅材料，還是UT SOI片。
對(duì)于聯(lián)電來說最大的問題是速度，格羅方德將在2014年啟用14nm XM工藝（如果不出意外的話），而聯(lián)電之前曾公布過一個(gè)計(jì)劃即將在2014年下半年實(shí)現(xiàn)14nm的FinFET工藝。但是考慮到聯(lián)電在2014年時(shí)才會(huì)上馬28nm HKMG工藝，中間隔了一個(gè)20nm工藝，因此它的14nm FinFET工藝的推出時(shí)間可能生變。
14nm工藝是個(gè)壁壘，也是一個(gè)“坎”，能夠跨越的廠商已不會(huì)超過10家，其中有技術(shù)問題，可能更多的是經(jīng)濟(jì)問題。因?yàn)?4nm工藝研發(fā)與制造的費(fèi)用太大，而市場(chǎng)缺乏足夠的需求來填補(bǔ)。但是在半導(dǎo)體業(yè)界中，目前各家代工商盡其所能互相爭(zhēng)艷，市場(chǎng)競(jìng)爭(zhēng)最終只剩下勝利者。
14nm是個(gè)“坎”
尺寸縮小是推動(dòng)產(chǎn)業(yè)進(jìn)步的“靈舟妙藥”，每?jī)赡瓿叽缈s小70%的魔咒至此沒有延緩的跡象，2011年是22nm工藝，到2013年工藝應(yīng)該到14nm。眾所周知，尺寸縮小僅是一種手段，如果缺乏尺寸縮小而帶來的紅利，業(yè)界不會(huì)盲目跟進(jìn)。依目前的態(tài)勢(shì)，業(yè)界已然有所爭(zhēng)議，有人認(rèn)為由28nm向22nm過渡時(shí)成本可能反而上升，這或是產(chǎn)業(yè)過渡過程中的正?，F(xiàn)象。
全球半導(dǎo)體業(yè)中還能繼續(xù)跟蹤14nm工藝節(jié)點(diǎn)者可能尚余不到10家，包括英特爾、三星，臺(tái)積電、格羅方得、聯(lián)電、東芝、海力士、美光等。顯然在半導(dǎo)體業(yè)中領(lǐng)軍尺寸縮小的企業(yè)是NAND閃存及CPU制造商及一批FPGA廠商。而如臺(tái)積電等代工制造商，由于從市場(chǎng)需求出發(fā)，通常工藝制程會(huì)落后一代。由此也并非表示代工模式一定會(huì)落后于IDM，因?yàn)槭袌?chǎng)經(jīng)濟(jì)是需要權(quán)衡技術(shù)能力與成本的。近期也出現(xiàn)如FPGA的Altera跳過臺(tái)積電而直接尋求與英特爾合作開發(fā)14nm FPGA，反映市場(chǎng)的錯(cuò)蹤復(fù)雜。
眾所周知，尺寸縮小僅是一種手段，如何繼續(xù)往下走，似乎業(yè)界把希望押寶在FinFET 3D工藝與EUV光刻上。從長遠(yuǎn)來看，集成電路產(chǎn)業(yè)的發(fā)展總是在性能、成本和功耗三者之間做平衡，由市場(chǎng)做出最后的選擇。應(yīng)在保持性能的前提下，盡可能地降低成本，同時(shí)在保持性能與成本的前提下應(yīng)該盡可能地降低功耗。
市場(chǎng)調(diào)研機(jī)構(gòu)Gartner的分析師Dean Freeman日前表示，目前半導(dǎo)體業(yè)界所面臨的情況與上世紀(jì)80年代的情形非常相似，當(dāng)時(shí)業(yè)界為了擺脫面臨的發(fā)展瓶頸，開始逐步采用CMOS技術(shù)來制造內(nèi)存和邏輯芯片，從而開創(chuàng)了半導(dǎo)體業(yè)界的新紀(jì)元。而目前采用FinFET的3D工藝會(huì)否產(chǎn)生同樣的光環(huán)，業(yè)界值得期待。
14nm納米是個(gè)壁壘或者“坎”。盡管英特爾至今并沒有疑慮，仍堅(jiān)挺采用193nm浸液式光刻加上兩次圖形曝光等輔助技術(shù)，將于2013年底時(shí)會(huì)推出14nm的測(cè)試芯片，并于2014年開始量產(chǎn)。然而在業(yè)界似乎已產(chǎn)生分歧，如臺(tái)積電從20nm之后的下一個(gè)工藝節(jié)點(diǎn)設(shè)定為16nm。
對(duì)于22nm/16nm級(jí)別的工藝制程，業(yè)界認(rèn)為有多種晶體管結(jié)構(gòu)可供選擇，包括III-V族溝道技術(shù)、體硅技術(shù)、FinFET立體晶體管技術(shù)、FD-SOI全耗盡型平面晶體管技術(shù)以及多柵立體晶體管技術(shù)等。但是依目前的分析來看，自14nm（包括14nm）之后，采用FinFET 3D結(jié)構(gòu)工藝或?qū)⒊蔀橹髁骷夹g(shù)。
在現(xiàn)階段尚有兩種技術(shù)在互相爭(zhēng)艷：一種是如英特爾表示會(huì)在22nm制程中開始采用FinFET結(jié)構(gòu)的三柵晶體管技術(shù)。另一種是如IBM、意法半導(dǎo)體等公司表示考慮在22nm制程節(jié)點(diǎn)時(shí)采用FD-SOI或者FD-UT SOI全耗盡技術(shù)。IBM公司曾經(jīng)在前兩年展示了一種基于超薄的FD-UT SOI工藝。此種工藝技術(shù)的優(yōu)點(diǎn)是仍然基于傳統(tǒng)的平面型晶體管結(jié)構(gòu)，不過這種工藝的SOI的硅層厚度非常薄，在5nm~6nm之間，這樣便于形成全耗盡（FD）結(jié)構(gòu)，能夠顯著減小短溝道效應(yīng)（SCE）的影響。
盡管英特爾與IBM雙方采用的工藝技術(shù)路線不盡相同，然而市場(chǎng)經(jīng)濟(jì)是公平的，雙方都會(huì)各展所長，根據(jù)市場(chǎng)需求做出權(quán)衡。
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