EDA仿真：VCS編譯Xilinx仿真步驟

VCS+Verdi的組合是EDA 仿真中必備神器，以前只會用Vivado自帶的仿真器或者M(jìn)odelsim來進(jìn)行仿真，但用了VCS+Verdi后，就不想再用vivado自帶的仿真器了，Verdi看波形、追信號實在是快太多了。

首先就是要用VCS把xilinx的仿真庫都編譯一遍，這樣才能用vcs進(jìn)行仿真。

打開vivado，在Tools下面有個Compile?Simulation Libraries.

選擇VCS，再指定庫文件存放的路徑；如果VCS的環(huán)境變量設(shè)置好了，那么會自動跳出Simulator executable path的路徑的。

在編譯過程中，可能會提示錯誤：

/apps/xilinx/Vivado/2021.2/data/systemc/simlibs/debug_tcp_server/debug_tcp_server_v1/src/RdWrTCPSocket.cpp: In member function ‘void RdWrTCPSocket::DataTransfer()’:
/apps/xilinx/Vivado/2021.2/data/systemc/simlibs/debug_tcp_server/debug_tcp_server_v1/src/RdWrTCPSocket.cpp:271:38: error: expected unqualified-id before ‘&’ token
    catch (const std::invalid_argument& e) {

打開cxl_error.log

可以看到，提示我們gcc版本有問題，而且在提示中，已經(jīng)指明了需要使用gcc 7.3，而我們當(dāng)前是11.2的版本。

更換gcc版本后，再重新編譯，就可以成功編譯出仿真庫。

編輯：黃飛

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