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Cadence向蘇格蘭設(shè)計(jì)中心添加新的SoC方法

PCB線路板打樣 ? 來源:LONG ? 2019-08-13 09:03 ? 次閱讀

SAN JOSE - Cadence Design Systems Inc.今天宣布推出基于塊的設(shè)計(jì)(BBD)和基于平臺(tái)的設(shè)計(jì)(PBD) )方法和工具流向蘇格蘭的阿爾巴中心。 BBD和PBD是用于片上系統(tǒng)(SoC)開發(fā)的一套完全編碼和驗(yàn)證的設(shè)計(jì)方法。

“BBD和PBD設(shè)計(jì)方法,以及之前由Cadence提供的時(shí)序驅(qū)動(dòng)設(shè)計(jì)TDD方法,代表完整SoC設(shè)計(jì)環(huán)境的重要組成部分,“Cadence方法論服務(wù)高級(jí)副總裁Adriaan Ligtenberg說。

這三種SOC設(shè)計(jì)方法是Alba中心工科學(xué)生課程的一部分。系統(tǒng)級(jí)集成研究所(ISLI),其中Cadence是主要參與者(參見4月在線出版物的故事)。 “我們感謝Cadence為該研究所及其成員大學(xué)提供的幫助,為我們的課程開發(fā)最先進(jìn)的SOC技術(shù)設(shè)計(jì)課程和項(xiàng)目,”ISLI主任Steve Beaumont教授說。

BBD和PBD方法建立在Cadence的TDD方法基礎(chǔ)之上,用于快速創(chuàng)建IP核。

BBD是一種通過流片輸出進(jìn)行寄存器傳輸級(jí)(RTL)設(shè)計(jì)的分層方法。它包括項(xiàng)目管理,時(shí)序驅(qū)動(dòng)的塊創(chuàng)作,分層芯片規(guī)劃,頂級(jí)芯片組裝和分層驗(yàn)證。它還包括測(cè)試,塊級(jí)驗(yàn)證,基于總線的設(shè)計(jì)和設(shè)計(jì)重用的方法。

PBD是一種基于平臺(tái)的SoC設(shè)計(jì)方法,建立在BBD的基礎(chǔ)之上,增加了功能用于嵌入式軟件設(shè)計(jì),模擬模塊設(shè)計(jì),高級(jí)系統(tǒng)設(shè)計(jì),快速原型設(shè)計(jì)和IP管理。它還包括一個(gè)參考多媒體設(shè)計(jì)平臺(tái)。

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