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Xilinx Vitis能創(chuàng)建的模板軟件工程

454398 ? 來源:博客園 ? 作者:HankFu ? 2020-11-12 12:06 ? 次閱讀

Xilinx的28nm、16nm SoC在業(yè)界應(yīng)用非常廣泛。最近也發(fā)布了7nm的SoC器件Versal VC1902和對(duì)應(yīng)的開發(fā)板VCK190。Versal是新一代的異構(gòu)計(jì)算平臺(tái),包含A72、R5、及內(nèi)部管理用的CPU。Versal的軟件開發(fā)工具是Vitis。

下面是在Vitis里創(chuàng)建軟件工程時(shí)可以看到的CPU清單。

每個(gè)CPU可以創(chuàng)建不同的軟件工程。對(duì)于A72的Standalone(Baremetal)工程,可選的模板如下:

對(duì)于A72的FreeRTOS工程,可選的模板如下:

對(duì)于PMC(Platform Management Controller),可以創(chuàng)建PLM(Platform Loader and Manager)工程。

對(duì)于PSM(Processing System Manager),可以創(chuàng)建Firmware工程。

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