ZYNQ進階：PL端實現(xiàn)串口UART的接收設計
在ZYNQ進階之路3中我們講解了PL端UART 發(fā)送的設計，本節(jié)我們講解PL端實現(xiàn)串口UART的接收設計；
下面主要是uart接收模塊的編碼講述，uart接收模塊設計主要分為波特率控制計數(shù)邏輯和按位接收邏輯，其具體編碼如下所示：
波特率控制計數(shù)邏輯：
其中325是根據(jù)主時鐘頻率為100Mhz，這里設置波特率為115200，所以計數(shù)值=100000000/115200/16=54；需要注意的是在串口接收中需要將一個波特率周期分成16份然后再一個波特率周期的第8份是進行采樣，所以需要進行16分頻；
按位接收邏輯：
通過檢測IsDone上升沿到來來檢測串口數(shù)據(jù)接收是否完成。讀者可自行將上一節(jié)中的串口發(fā)送模塊和本節(jié)的接收模塊組合成一個工程，實現(xiàn)通過USB轉串口電路模塊實現(xiàn)PC端發(fā)送數(shù)據(jù)相應返回同樣的數(shù)據(jù)給PC，實現(xiàn)回環(huán)測試功能。
編輯：hfy
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