5G毫米波集成天線一體化技術(shù)的發(fā)展趨勢

作為5G大規(guī)模多輸入/多輸出( MIMO) 的技術(shù)支持，毫米波天線集成技術(shù)是實現(xiàn)高分辨數(shù)據(jù)流、移動分布式計算等應用場景的關(guān)鍵技術(shù)。討論了封裝天線( AiP) 、片上天線( AoC) 、混合集成等毫米波天線集成技術(shù)發(fā)展狀況、關(guān)鍵技術(shù)及其解決方案，剖析了幾種典型集成天線技術(shù)，分析了技術(shù)發(fā)展脈絡，總結(jié)了5G毫米波集成天線一體化技術(shù)的發(fā)展趨勢。

比如：針對生命體征監(jiān)測和姿勢識別，IMEC開發(fā)了一款帶有片上天線的140GHz FMCW雷達收發(fā)器。雷達的工作范圍為0.15米至10米，分辨率為11毫米，射頻帶寬為13GHz，中心頻率為145GHz，收發(fā)器IC采用28nm模塊CMOS技術(shù)制造，可實現(xiàn)低成本的解決方案。

引 言

毫米波半導體是第五代移動通信技術(shù)( 5G ) 的基礎器件，采用毫米波頻率進行定向通信的技術(shù)是5G預期配置的關(guān)鍵技術(shù)之一。毫米波的頻率范圍為30～300 GHz。目前研究的波段范圍有28 GHz頻段、 38 GHz頻段、 60 GHz頻段和E頻段( 71 ～ 76 GHz、 81～86 GHz) 。5G技術(shù)將通信頻段移向比第四代移動通信技術(shù)(4G) 高得多的毫米波頻率。5G的頻譜帶寬較4G會有10倍至20倍的提升，最高數(shù)據(jù)傳輸速率可以提高20倍，且天線陣列和基站設備的尺寸更小、成本更低。在毫米波頻段中， 28 GHz頻段、 60 GHz頻段是最有希望應用于5G的兩個頻段。

作為收發(fā)ＲF信號的無源器件，天線決定了通信質(zhì)量、信號功率、信號帶寬、連接速度等通信指標，是通信系統(tǒng)的核心。如何增加頻譜數(shù)據(jù)吞吐量是從4G 到5G的重大挑戰(zhàn)。5G的關(guān)鍵技術(shù)為大規(guī)模多輸入、多輸出( MIMO )的集成毫米波天線技術(shù)。每一個MIMO信道有著自身的從接收天線、發(fā)射天線到微處理器的信號通路。接收信道的作用是實現(xiàn)從天線接收ＲF 信號到輸入采樣基帶頻率的下變頻， 以及模數(shù)信號轉(zhuǎn)換等功能。發(fā)射信道的功能是將上變頻后的數(shù)字信號轉(zhuǎn)換為模擬ＲF信號?？s小尺寸是5G天線的一個重要挑戰(zhàn)。最小的基站天線尺寸將縮小到信用卡大小，這會增大毫米波天線及電路在集成度、低功耗和連接方面的要求。提升功率密度是5G天線的另一個重要挑戰(zhàn)。

多天線系統(tǒng)集成是應對5G系統(tǒng) MIMO 、縮小尺寸、提升功率密度等挑戰(zhàn)的重點技術(shù)之一。由于SiGe和 CMOS ＲF集成電路已經(jīng)達到高的fT、 fmax和高的集成密度，能采用CMOS、 SOI和SiGe工藝來設計大規(guī)模全集成硅毫米波相控陣電路?；谌褾結(jié)構(gòu)、 8～32元的發(fā)射( Tx ) 、接收( Ｒx ) 或收/發(fā)( T/ Ｒ) 模式已成功用于45～110 GHz頻段。硅集成方案可以在同一芯片上集成多個元件。與GaAs和InP等 Ⅲ-Ⅴ族半導體技術(shù)相比較，硅基技術(shù)具有更高的集成度和更低的成本。硅相控陣芯片在毫米波領域中應用廣泛。該項技術(shù)所面臨的挑戰(zhàn)是，在信號鏈單元上的ＲF功率放大器、低噪聲接收機放大器、 A/D轉(zhuǎn)換器或D/A轉(zhuǎn)換器都需要很大的效率提升。

無線通信和傳感器系統(tǒng)均可以通過ＲF系統(tǒng)提高集成度和采用新封裝技術(shù)的方法來提高性能。目前實現(xiàn)前端電路和集成天線的方案有三種。第一種為天線封裝( AiP ) 技術(shù)，天線采用IC封裝工藝制作。第二種為芯片上天線( AoC) 技術(shù)，天線直接在 硅襯底上制作。第三種為AiP和AoC的混合技術(shù)，天線饋電點制作在芯片上，輻射元件在片外實現(xiàn)。AiP技術(shù)中，芯片和天線的互連在某個頻率范圍內(nèi)應該達到信號傳輸?shù)挠行?，其主要的封裝工藝有引線鍵合工藝和倒裝芯片工藝。但是，器件在高頻時的損耗較大，成本將升高。

1、相控陣接收機的結(jié)構(gòu)

硅毫米波相控陣技術(shù)在5G通信中的應用范圍不斷擴大。多家公司采用SiGe 和CMOS工藝來制作IC，其工作頻率已達60～100GHz。例如，北美豐田研究所研制了一種具有ＲF波束形成能力的SiGe單芯片汽車相控陣接收機［1］，如圖1所示。

汽車相控陣接收機采用低成本的鍵合線技術(shù)進行封裝，并與16元線性微帶陣列連接。該天線在77～ 81 GHz頻率的指向性為29. 3 dB，增益為28 dB，每步( 1°) 在方位角平面中能掃描到±50°。該芯片中，平面相控陣天線陣列間距只有0.5λ( λ=3. 75 mm，頻率80 GHz 以下) ，這個參數(shù)對于可用面積很小的毫米波電路尤其重要。這種相陣列需要盡可能多地在SiGe或者CMOS芯片上集成更多電路，不僅包括移相器和VGA，而且包括全部的發(fā)射/接收電路、功率合成網(wǎng)絡、數(shù)字與SPI控制、偏置電路，某些情況下還包括完整的上/下轉(zhuǎn)換器。

圖1毫米波汽車相控陣接收機

2、天線集成技術(shù)

目前， 60 GHz封裝的天線和片上天線均使用商用電磁仿真軟件進行設計。對于混合解決方案，已開發(fā)出補充標準IC設計工具的建模方法，以實現(xiàn)引線鍵合與 IC 的協(xié)調(diào)集成。AiP技術(shù)需要確保整體性能的IC與天線間的寬帶低損耗互連設計。AoC技術(shù)需要先進的后處理步驟或封裝工藝，以減少嚴重的介電損耗?；旌咸炀€集成技術(shù)則融合了AiP和AoC的優(yōu)勢，可實現(xiàn)高輻射效率，無需芯片與封裝的低損耗互連設計。但是，該方案的設計靈活性不高，且在寬側(cè)方向上呈現(xiàn)輻射零點，阻止了其在某些場合的應用。

2. 1 AiP技術(shù)

2. 1. 1結(jié)構(gòu)

AiP技術(shù)是將一元或多元天線集成到ＲF封裝內(nèi)的關(guān)鍵技術(shù)，其典型方案是采用集成電路封裝工藝。在硅毫米波收發(fā)器中，封裝內(nèi)集成了天線陣列，有助于提供足夠的信號增益，實現(xiàn)尺寸最小化。這種工藝是毫米波ＲF集成方案規(guī)模應用的關(guān)鍵技 術(shù)。例如，30 GHz天線元的尺寸為毫米量級，在單個封裝內(nèi)需要采用新類型的天線陣列集成技術(shù)。具有光束轉(zhuǎn)向功能的微小相控陣天線是毫米波無線電的關(guān)鍵器件［2］。為了在收發(fā)器封裝內(nèi)集成天線陣列，需要考慮芯片組裝方案、陣列元和饋電網(wǎng)絡、芯片與封裝互連、封裝材料等。如果收發(fā)器采用多層封裝，需要在芯片與天線之間采用先進的互連技術(shù)，滿足天線饋電插入損耗最小的要求。芯片可以放置 在封裝正面，也可以放置在封裝底部。

將芯片放置在封裝底部的方案對芯片接收和發(fā)射的影響最小。一種可用于5G無線通信的有機芯片封裝中的相控陣毫米波天線如 圖2所示。為了提高天線帶寬、增益和輻射效率，在一個厚的覆板上放置了一個寄生平面結(jié)構(gòu)，構(gòu)成一個雙貼片天線疊層。為了達到優(yōu)化ＲF設計和制造的目標，對封裝層疊片和低介電常數(shù)材料的參數(shù)作了優(yōu)化選擇，如表1所示。

圖2有機芯片封裝中的相控陣毫米波天線

表1天線陣列設計要求

2. 1. 2設計與制造

在AiP設計中，除了波束形成、信號放大和具有頻率轉(zhuǎn)換功能的相控陣IC外，具有極化特性的天線也是天線陣列的關(guān)鍵器件。在最早的硅基毫米波IC設計發(fā)展階段，天線設計采用襯底、形狀和成本與硅基毫米波IC兼容的技術(shù)［3］。目前，已有多種頻率的硅襯底片上毫米波天線，但由于面積較大、發(fā)射效率有限，在100 GHz以上的天線才有研究價值。在60 GHz頻率內(nèi)，在液晶聚合物( LCP) 、有機高密度互連襯底、玻璃襯底、高/低溫共燒陶瓷襯底、硅襯底和模制物料基晶圓級襯底等材料上制作的硅相控陣天線陣列已被報道。通常需要對AiP陣列的增益、帶寬和輻射圖形進行優(yōu)化。同時，需要考慮襯底材料、陣列尺寸(即元件和貼片的數(shù)量) 、互連靈活性(如連接電源和控制信號) 、熱性能與機械性能的相容性、 IC組裝和板集成等因素。

一種新的天線與 IC/載體結(jié)構(gòu)如圖3所示［4］。天線結(jié)構(gòu)通過PCB板制作于厚度為T的介質(zhì)襯底上，并懸空倒置，翻轉(zhuǎn)在IC/載體之上。IC封裝基的地也作為天線的鏡像地，天線與地的間距為H。該結(jié)構(gòu)中，天線與地板之間具有非常低的介電常數(shù)，天線結(jié)構(gòu)之上有一層具有較高介電常數(shù)的覆板材料。在保持高天線效率的前提下，相比于標準PCB天線結(jié)構(gòu)，這種堆疊結(jié)構(gòu)具有更高的帶寬。一個帶有焊球的墊片可以放置在天線覆板的另一端，作為支撐。

圖3天線與IC/載體結(jié)構(gòu)

AiP設計中通常采用集成電路封裝工藝進行封裝，需要將天線與片上電路進行物理連接。低溫共燒陶瓷( LTCC) 工藝可實現(xiàn)任意數(shù)量層的安裝結(jié)構(gòu)， 具有跨層過孔、層間形成開放腔或密閉腔(IC 可集成于此) 等靈活性。采用該工藝封裝的毫米波天線越來越受到關(guān)注［5］。有些方案采用傳統(tǒng)的鍵合線、 倒裝芯片和C4焊接等工藝。例如， 60 GHz硅相控陣芯片封裝需要有芯片與天線間低損耗分布網(wǎng)絡的多層毫米波襯底，必須是多層低損耗的Teflon基或 LTCC 基，成本昂貴。因此，典型的硅相控陣AiP可以達到30 ～ 60 GHz頻率［6］，達到80 GHz的難度更大。

較之LTCC封裝方案，印刷電路板( PCB) 封裝方案可以降低成本。有采用PCB等較低成本高頻電路材料制成多層安裝結(jié)構(gòu)的封裝方案，如ＲO3000系列和ＲO4000系列［7-8］的封裝。還有采用液晶聚合物作為基板的低成本方案。但由于使用盲孔或埋孔，層的數(shù)量增多，會導致PCB技術(shù)的機械制造成本升高。另外， PCB工藝在極高頻段實現(xiàn)高密度化的難度增加，這將嚴重影響系統(tǒng)性能，導致效率降低。因此， LTCC工藝是大多數(shù)多層結(jié)構(gòu)陣列的選擇，采用該工藝方案的天線性能有改善。

2. 2 AoC技術(shù)

2. 2. 1片上天線

片上天線是采用片上金屬化連線工藝集成制作的天線。在芯片上直接集成和組合天線的制作方法是太赫茲通信器件研究最少的領域之一。在當前技術(shù)條件下，由于襯底吸收和傳導電流等原因，消除ＲF電路與天線間所有的連接會使得設計成本大幅 降低，設計更加靈活。傳統(tǒng)觀念認為，由于沒有介電鏡( Dielectric Lenses) 補償結(jié)構(gòu)，片上天線對于消費類的小功率器件并不是最佳結(jié)構(gòu)。雖然典型片上天線的效率只能達到10%，但如果能在片上設計并制造出亞毫米天線( 采用選頻性質(zhì)的表面［9］或者Yagi高方向性的天線［10］) ，則會帶來成本大幅降低和設計靈活性大幅增加的優(yōu)勢，這會超過使用效率更高、但昂貴且復雜的片下天線的優(yōu)勢，從而增加了應用的可能性。

隨著載波頻率和帶寬移向亞太赫茲，高寬帶和高載波頻率使得金屬引線變得不穩(wěn)定，片上天線被認為是替代印刷板上芯片金屬互連的方法之一。除了片上天線，片上波導和硅穿孔( TSV) 波導也是亞太赫茲頻段大帶寬應用中替代金屬連線的有前景的技術(shù)。片上天線的成功實現(xiàn)將會使得高集成度收發(fā)器、60 GHz 空間電源組合和更高頻率毫米波系統(tǒng)等眾多應用受益。頻率從0. 9GHz［11］到77 GHz［12的多種頻率片上天線已有不少報道。德國高性能微電子研究所( IHP) 采用標準SiGe BiCMOS工藝，設計并制作了一種130 GHz的片上天線，峰值增益達到8. 4 dBi。

2. 2. 2 CMOS片上天線

CMOS工藝是 ＲF IC 的一條重要發(fā)展途徑。隨著CMOS管特征頻率( fT) 接近400 GHz［14］， CMOS工藝在毫米波 IC 中得到進一步應用。文獻［ 15］提 出了一種在CMOS芯片上集成人工磁導體和寬帶窄槽天線的新方法，采用標準CMOS工藝實現(xiàn)了60 GHz下2 dBi的增益和大于126%的阻抗帶寬。文獻［ 16］采用0. 18 μm CMOS工藝，制作了一種60 GHz的圓極化環(huán)形天線，具有覆蓋57～67 GHz的模擬和測量的軸向比( axial ratio， AＲ＜3) 帶寬，增益達4. 4dBi。文獻［ 17］采用能制作阻抗帶寬為25 GHz ( 45～70 GHz) 的器件的Si CMOS工藝，制作了一種60 GHz寬帶的單極子天線，在60 GHz下實現(xiàn)了－ 4. 96 dB的增益。文獻［18］提出了一種高增益( 8 dBi 最大增益) 和高效率( 96. 7%峰值天線效率) 的片上天線，采用CMOS 0. 18 μm工藝制作，天線的－ 10 dB帶寬為4 GHz。文獻［19］采用0. 18 μm CMOS工藝，制作了一種60 GHz帶寬的CPW饋電環(huán)形單極子天線。

通常，制作在摻雜硅襯底上的片上天線只有約10%的低效率。但若采用成本較高的封裝天線，可實現(xiàn)比片上天線更高的效率。可采用容性耦合等先進連接技術(shù)，將成熟、低成本、較少摻雜的襯底上制作的天線芯片與有源60 GHz毫米波ＲF芯片連接起來，以實現(xiàn)比采用標準鍵合工藝的器件高得多的工作頻率范圍。天線可以用低成本的工藝( 如0. 18或0. 35 μm) 和較低摻雜的襯底來制作，再通過容性耦合，連接到含60 GHz 功率放大器等有源元件上，而不采用更先進工藝［20］。一種通過容性耦合將天線芯片與有源60 GHz ＲF芯片連接的毫米波集成天線如圖4所示。該天線不僅具有舊工藝的低摻雜濃度、高電阻率所致的低電導性、低損失襯底，而且具有更高效率。制作天線陣列時，低速有源開關(guān)( 如二極管) 可以集成到芯片上，采用分相位無源饋線來執(zhí)行元件調(diào)諧、移相和波速控制。

圖4通過容性耦合將天線芯片與有源60 GHz ＲF芯片 連接的毫米波集成天線

2. 3混合集成毫米波天線

混合集成毫米波天線就是采用專用工藝，將天線與前端 IC 集成在同一封裝中。這種制作技術(shù)是純AiP和AoC的替代技術(shù)?；旌霞商炀€的示意圖如圖5所示［21］。熔融石英襯底上的偶極天線的 一半安裝在片上，另一半安裝在片下。這種結(jié)構(gòu)的天線可以直接連接到片上電子器件。在60 GHz全頻段內(nèi)，當增益為6～8 dBi時，芯片最大輻射效率可達90%。

圖5混合集成天線概念示意圖

3、毫米波天線集成技術(shù)進展

3. 1學術(shù)界發(fā)展情況

物聯(lián)網(wǎng)( IoT) 和5G要實現(xiàn)全面互聯(lián)的目標，就需要開發(fā)不同毫米波頻段的天線，并實現(xiàn)商業(yè)化量產(chǎn)。表2總結(jié)了用于廣域IoT和5G無線通信的近期文獻中毫米波天線及其性能比較?？梢钥闯觯瑢嵱玫慕鉀Q方案仍然較少，多數(shù)方案仍然需要解決結(jié)構(gòu)復雜、增益減少、效率低和功耗高等問題。

60 GHz毫米波段器件將應用5G并量產(chǎn)化。片上系統(tǒng)或片上前端小型化系統(tǒng)集成的發(fā)展趨勢要求在不犧牲輻射效率、帶寬、增益的前提下，AoC器件、AiP器件的成本、尺寸和功耗必須向更小化方向發(fā)展。使用硅IC工藝提供了最大的集成度、低成本和低功耗，表明GaAs等Ⅲ-Ⅴ族化合物工藝并不一定是最佳選擇，尤其是考慮封裝、集成和互連問題時。

表2近期文獻中5G毫米波天線及其性能比較

天線元件通常制作于片下，也可以被完整地集成在單個芯片上。硅襯底由于介電常數(shù)高、電阻率低，片上集成天線的增益很小、輻射效率很低，可以通過提高襯底的電阻率來改善性能。例如制作高性能低成本的SoC時，將天線和IC集成到高電阻率絕緣層上硅( HＲ SOI) 上。在AiP方案中，為解決毫米波頻率下硅襯底上天線陣列的平面饋電器件插入損耗過大的問題，可采用將天線集成在附加基板上的混合集成創(chuàng)新技術(shù)，充分利用封裝和在這種有限空間內(nèi)的耦合可能性。該方案顯現(xiàn)出較高的設計靈活性。

IBM公司在過去的14年中發(fā)展了ＲFIC和AiP系列: 成像和通信應用的具有波束形成和波束掃描能力的性能驅(qū)動相控陣( 如60 GHz、 94 GHz和28 GHz相控陣) ，支持便攜裝置的V-波段、W波段和Ka波段毫米波模塊( 如60 GHz單元件、開關(guān)波束模塊)［27］。

文獻［ 28］提出一種多層LTCC基板上構(gòu)建的線性極化6 GHz天線陣列。這些陣列使用4×4微帶貼片輻射元件，分別由四分之一波長匹配的T型接頭網(wǎng)絡和Wilkinson功率分配器網(wǎng)絡饋電。測量結(jié)果表明，由前者饋電的陣列比由后者饋電的陣列表現(xiàn)更好。對于帶有和不帶有嵌入式腔的陣列，測量的阻抗帶寬分別為9. 5%和5. 8%，最大增益分別為18. 2 dBi和15. 7 dBi。

文獻［ 29］報道了一種在熔融石英基板上構(gòu)建的線性極化60 GHz天線陣列。該陣列使用由饋電網(wǎng)絡饋電的2×4微帶貼片輻射元件，饋電網(wǎng)絡使用了共面條帶和共面條波導。通過金屬腔增強的陣列實現(xiàn)了大于9 GHz的測量阻抗帶寬和約15 dBi的最大增益。

文獻［ 30］提出一種采用LTCC工藝、具有2×2微帶貼片輻射元件的天線陣列，制作出具有線性極化的60 GHz發(fā)射器模塊。

文獻［ 31］分別使用1×8和2×5微帶貼片輻射元件，制作出兩個有源線性極化60 GHz天線陣列。

文獻［ 32］提出了一種具有由波后波導網(wǎng)絡饋電的槽輻射元件、線性極化60 GHz的天線陣列。

文獻［ 33］提出了一種圓極化60 GHz的天線陣列，該陣列通過對原始天線元件、疊層波導、調(diào)整圓極化軸比進行精細設計，實現(xiàn)了寬帶寬。

文獻［ 34］提出了一種在 LCP 基板上制作的圓極化 60 GHz 天線陣列。該陣列采用了新的槽輻射元件和新穎的開腔反射器。測量結(jié)果表明， 2×4輻射元件陣列的峰值增益為15. 6 dBic。

3. 2 商業(yè)化發(fā)展態(tài)勢

據(jù)Gartner 預測，到2021年，市場將有9%的智能手機支持5G網(wǎng)絡。5G采用波束成形技術(shù)，必須采用多天線陣列系統(tǒng)( Massive MIMO) 。這將導致天線呈量級增長，并推動天線向高度集成化、復雜化的方向發(fā)展，工藝技術(shù)不斷升級，新材料不斷應用。例如，新型材料液晶高分子聚合物( LCP) 材料具有低損耗、高靈活性、高密封性等優(yōu)點，非常適用于制作微波、毫米波器件。蘋果公司推出的毫米波天線解決方案中包含采用LCP材料制作的天線，這是5G天線大規(guī)模商用化的一個重要方向［35］。

高通公司QTM052毫米波天線模組系列支持緊湊封裝尺寸，適合于移動終端集成。配置QTM052的毫米波天線模組的終端將于2019年上半年推向市場，顯示出在5G中集成天線和ＲF前端等元器件的發(fā)展趨勢。意法半導體公司、 STATS ChipPAC和英飛凌科技公司在英飛凌第一代嵌入式晶圓級球柵陣列 ( eWLB) 技術(shù)的基礎上，合作開發(fā)了下一代的eWLB半導體產(chǎn)品封裝技術(shù)。目前已開發(fā)出具有8 mm×8 mm封裝的集成天線制作的四通道收發(fā)器。該天線采用ＲDL層中的金屬結(jié)構(gòu)，并集成于封裝中，為在5G等毫米波領域應用的雷達系統(tǒng)封裝提供了解決方案［36］。近期，中芯長電公司發(fā)布了SmartAiPTM工藝平臺制作的世界首個超寬頻雙極化的5G毫米波天線芯片的晶圓級集成封裝，具有集成度高、散熱性好、工藝簡練的特點，能夠?qū)崿F(xiàn)24～43 GHz的超寬頻信號收發(fā)，達到 12. 5 dB的超高天線增益。

4、結(jié)束語

在未來的較長時間里， 5G架構(gòu)將繼續(xù)在網(wǎng)絡、 無線訪問和物理層不斷發(fā)展，需要在ＲF/ 毫米波集成電路、毫米波天線陣列技術(shù)等方面擁有多種創(chuàng)新型產(chǎn)品組合，從而推動5G無線電和產(chǎn)業(yè)化發(fā)展。例如， 5G中功率放大器、天線、濾波器和匹配電路的數(shù)量可以高達64個或更多。這些組件在效率和集成度方面的提升對無線電的總體能效和性能十分重要。具有大量天線、頻率為27 GHz及以上的高集成度MIMO無線電是5G系統(tǒng)的關(guān)鍵技術(shù)。上述三種集成方案可用于毫米波天線設計。以60 GHz頻段為例， AoC器件的輻射效率和增益指標落后于AiP器件和混合方案。AiP器件和混合器件實現(xiàn)了最佳輻射效率，因此可以認為選用AiP技術(shù)比選用AoC技術(shù)更合適。

AiP技術(shù)具有設計靈活性和印刷天線結(jié)構(gòu)的優(yōu)勢，但對于復雜的多層封裝結(jié)構(gòu)，可能不具備與AoC技術(shù)和混合方案同等成本競爭的條件。此外， AiP方案芯片到芯片的互連會導致熱損失、延遲和設計量增加?；旌戏桨杆坪跏亲詈玫姆桨浮５?，當頻率超過60 GHz時，典型的混合技術(shù)、 AiP都是不夠成熟的方案。而AoC方案會更加完善，且已在THz波段進行了測試。據(jù)預期，AoC方案在高頻具有更大發(fā)展空間。

天線集成的一個根本解決方案是將一個相控陣所需的所有東西集成到一個芯片上，這是硅基毫米波天線系統(tǒng)的優(yōu)勢所在。不僅集成電子器件，而且集成通向晶圓級實現(xiàn)的高效率天線。晶圓級相控陣就可放置在輸入/輸出數(shù)據(jù)信號高達Gbit/s、布置有控制器件和電源器件的低成本印刷電路板上。整個毫米波功能均集成于同一芯片上，這種晶圓規(guī)模的實現(xiàn)是一個完全自包含的解決方案。（參考文獻略）

原文標題：毫米波天線集成技術(shù)研究進展

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