電子發(fā)燒友網(wǎng)報(bào)道(文/周凱揚(yáng))隨著人工智能和機(jī)器學(xué)習(xí)的崛起,人工成本的提高,不少人類崗位被機(jī)器所替代,甚至許多重度依靠腦力活動(dòng)的工作也在被危及,后端設(shè)計(jì)工程師就是其中之一。 EDA在不斷的迭代升級(jí)下,工程師們用起來也越來越得心應(yīng)手,工作量都得到了簡化。但諸位后端設(shè)計(jì)工程師有沒有害怕自己吃飯的工具變得越來越智能,最終有一天替代自己?EDA
引入機(jī)器學(xué)習(xí),是威脅還是福利?
Cerebrus floorplan自動(dòng)優(yōu)化 / Cadence 在Cadence給出的演示中,5nm手機(jī)CPU需要工程師團(tuán)隊(duì)數(shù)月的工作,最終實(shí)現(xiàn)了3.5GHz的頻率。而在運(yùn)用Cerebrus的幫助下,1名工程師在10天內(nèi)的時(shí)間里就將頻率提升了420MH。這樣的生產(chǎn)力提升升可能是每個(gè)芯片設(shè)計(jì)公司都想要看到的結(jié)果,因?yàn)樗母嗍荂PU的時(shí)間而不是工程師自己的時(shí)間,更不用說可觀的性能提升了。 考慮到Cerebrus正是希臘神話中看守地獄的三頭犬Cerberus的易位詞,說不定對(duì)許多初級(jí)工程師來說真的象征著“地獄”之門大開。 但它真正的象征意義可能更接近于大腦“Cerebrum”,為工程師們提供一個(gè)擁有自主思考能力的工具,同時(shí)也幫助工程師構(gòu)思更好的芯片設(shè)計(jì)。據(jù)外媒Anandtech了解到,Cadence提供的工具里還會(huì)加入回放功能?;胤殴δ軙?huì)記錄增強(qiáng)學(xué)習(xí)的過程中每一次迭代,這讓工程師可以更好地確定設(shè)計(jì)過程,并理解最終設(shè)計(jì)。
芯片設(shè)計(jì)上的人類VS機(jī)器學(xué)習(xí),已有敗績
引入機(jī)器學(xué)習(xí),是威脅還是福利?
許多頂尖的IC設(shè)計(jì)都需要在設(shè)計(jì)上進(jìn)行優(yōu)化,從而改善我們常說的PPA(性能、功率、面積,有時(shí)還有成本)。在規(guī)劃好芯片架構(gòu),確定了工藝節(jié)點(diǎn)后,剩下的開發(fā)工作就是設(shè)計(jì)了。不少設(shè)計(jì)工作,需要工程師團(tuán)隊(duì)數(shù)月的優(yōu)化,EDA廠商推出云方案之后,也有部分公司借助云方案來完成優(yōu)化和驗(yàn)證工作,以求節(jié)省總開發(fā)周期。 以上過程的主導(dǎo)者依然是設(shè)計(jì)者本身,甚至不少設(shè)計(jì)者認(rèn)為當(dāng)今的芯片復(fù)雜度是機(jī)器學(xué)習(xí)和AI無法企及的,而且還在飛速增長中。然而在機(jī)器學(xué)習(xí)的演進(jìn)下,EDA一直在研究如何將其引入軟件中去,為芯片設(shè)計(jì)帶來顛覆性的改變。
Cerebrus對(duì)生產(chǎn)力和PPA的提升 / Cadence Cadence就在近日推出了Cerebrus Intelligent Chip Explorer工具,一個(gè)基于機(jī)器學(xué)習(xí)的設(shè)計(jì)工具。據(jù)Cadence給出的數(shù)據(jù),結(jié)合Cerebrus和Cadence RTL-to-signoff流程,與人工加非機(jī)器學(xué)習(xí)的方案相比,生產(chǎn)力最多提高10倍,PPA將改善20%。三星Foundry設(shè)計(jì)技術(shù)副總裁更是提到,在運(yùn)用了Cerebrus與Cadence結(jié)合的數(shù)字設(shè)計(jì)流程后,僅用幾天時(shí)間就降低了8%以上的功耗,而過去人工操作則需要耗時(shí)幾個(gè)月。
芯片設(shè)計(jì)上的人類VS機(jī)器學(xué)習(xí),已有敗績
在這場(chǎng)人類與機(jī)器學(xué)習(xí)的設(shè)計(jì)大戰(zhàn)里,其實(shí)人類已經(jīng)有過敗績了。今年6月9日,谷歌在《自然》雜志上發(fā)表了一篇論文,就講述了谷歌計(jì)劃用AI來設(shè)計(jì)下一代AI加速器(TPU)。 該論文著重說明了在機(jī)器學(xué)習(xí)在布局上的優(yōu)勢(shì),自動(dòng)布局布線已經(jīng)不是什么新鮮事了,然而機(jī)器學(xué)習(xí)的引入還是為其算法帶來了大革新。論文稱復(fù)雜芯片的設(shè)計(jì)需太過耗時(shí),工程師需要花上大量時(shí)間來布局和迭代其設(shè)計(jì),每次設(shè)計(jì)后最多還要72小時(shí)來評(píng)估,最終導(dǎo)致工程時(shí)長拖到數(shù)月之久。 這在AI芯片公司尤其常見,不少大會(huì)上AI芯片公司大肆宣揚(yáng)其核心設(shè)計(jì),但最終芯片成品可能要數(shù)個(gè)月乃至一年后才能推出。只有設(shè)計(jì)評(píng)估工作順利進(jìn)行,才會(huì)擁有比上一版更優(yōu)秀的PPA。 在谷歌的實(shí)驗(yàn)中,他們根據(jù)大量網(wǎng)表和布局建立了一個(gè)神經(jīng)網(wǎng)絡(luò)。同樣在6個(gè)小時(shí)的設(shè)計(jì)流程下,該方法生成的floorplan從各個(gè)層面上都優(yōu)于或近似于人類手工設(shè)計(jì)。
人機(jī)對(duì)比 / Nature
上圖就是谷歌曾經(jīng)展示過的人機(jī)大戰(zhàn)結(jié)果,左圖為人工設(shè)計(jì)的floorplan,花費(fèi)了6至8周的工作時(shí)間。而右圖是AI設(shè)計(jì)的floorplan,僅僅花費(fèi)了24個(gè)小時(shí)。不過因?yàn)榘藱C(jī)密設(shè)計(jì),兩張圖都已經(jīng)經(jīng)過了模糊處理。
盡管從這些例子看來,工程師的位置岌岌可危,但這些并不是EDA引入機(jī)器學(xué)習(xí)的意義。Synopsys其實(shí)也早在去年推出了AI驅(qū)動(dòng)的設(shè)計(jì)系統(tǒng)方案DSO.ai,其團(tuán)隊(duì)在官方采訪中提到:DSO.ai之類方案并非芯片設(shè)計(jì)的“綠色按鈕”,一鍵按下交由AI自行操作。真正的權(quán)力依然掌握在設(shè)計(jì)者手中,只不過將不少設(shè)計(jì)工作從手動(dòng)變?yōu)榱苏嬲饬x上的自動(dòng)而已。
結(jié)語
雖然EDA確實(shí)都在逐步引入機(jī)器學(xué)習(xí),但這與過去的升級(jí)其實(shí)性質(zhì)無差,仍然是在為工程師省去重復(fù)性的優(yōu)化排錯(cuò)工作。目前這些工具所能提供的依然是“AI輔助芯片設(shè)計(jì)”,而不是“AI自動(dòng)設(shè)計(jì)芯片”。
“自己設(shè)計(jì)的AI芯片替代自己”的情況在很長一段時(shí)間內(nèi)都不會(huì)發(fā)生的。再者,編者的工作可能會(huì)比諸位工程師更早一步被機(jī)器學(xué)習(xí)和AI替代,屆時(shí),它們寫出的文章可能會(huì)換上一個(gè)更有威懾力的標(biāo)題。
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