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在TX與RX之間必然會出現(xiàn)的信號發(fā)送技術(shù)

電子設(shè)計 ? 來源:網(wǎng)友電子設(shè)計發(fā)布 ? 作者:網(wǎng)友電子設(shè)計發(fā)布 ? 2021-11-23 17:10 ? 次閱讀

在上篇博客《理解JESD204B協(xié)議》中,我對 JESD204B 協(xié)議中的三個狀態(tài)進行了概括性的功能介紹。這三個狀態(tài)對于在鏈路的 TX 和 RX 之間構(gòu)建有效數(shù)據(jù)鏈路非常重要,它們是:代碼組同步 (CGS)、初始信道對齊序列 (ILAS) 和用戶數(shù)據(jù)。今天我將探討在 TX 與 RX 之間必然會出現(xiàn)的信號發(fā)送技術(shù),完成構(gòu)建有效鏈路所需的必要步驟。

假設(shè)您已經(jīng)在 TX 與 RX 之間建立了所需的電氣連接,如圖 1 所示。請注意圖中箭頭表示信號方向。

從 TX (tx_dataout) 到 RX 的信號是包含數(shù)據(jù)鏈路的串行解串器信道信號。這些信號不需要偏移對齊。從 RX 回到 TX 的信號是 SYNCn 請求信號。

時鐘芯片通常是 LMK04828 超低抖動合成器與抖動清除器,可為 txlink_clk 和 rxlink_clk 提供一個器件時鐘。此外,它還可提供用來同步 TX 和 RX 時間域的 SYSREF。

發(fā)送器和互補的接收器包含 8b/10b 編碼、數(shù)據(jù)鏈路層、擾頻器和傳輸層。我們假設(shè)發(fā)送器和接收器都采用相同的 LMFS 配置和 PLL 設(shè)置。

要在經(jīng)過 JESD204B 協(xié)議的各個狀態(tài)時檢驗信號,可使用 FPGA 廠商提供的信號分析工具。

構(gòu)建 JESD204B 鏈路的第一步是 RX 發(fā)信號通知 TX 開始代碼組同步 (CGS):

a.) RX 針對 TX 降低 SYNC 信號,請求執(zhí)行 CGS。

b.) TX 的回應(yīng)將是開始發(fā)送 K28.5 字符(8b/10b 編碼之前的 0xBC 十六進制)。

c.) RX 接收到并最少解碼 4 個 K28.5 字符后,它會提高 SYNC 信號,讓 TX 開始發(fā)送 ILAS 序列。

d.) 一旦 SYNC 升高,TX 就會在本地多幀時鐘(LMFC,LMFC 在圖中未顯示)的上升沿位置的每個信道上發(fā)送 ILAS 信號。所有信道都將從源頭與該 LMFC 邊沿對齊。

e.) ILAS 總是包含 4 個多幀數(shù)據(jù)。每個多幀數(shù)據(jù)都以一個 K28.0 字符開始,以一個 K28.3 字符結(jié)束。鏈路配置數(shù)據(jù)在第 3 個八位位組開始的位置通過第二個多幀數(shù)據(jù)發(fā)送。

f.) 圖 4 概括說明了 ILAS 多幀數(shù)據(jù)的結(jié)構(gòu),這可在 TX 發(fā)出的 ILAS 八位位組數(shù)據(jù)流中證實。K28.0=R 和 K28.3=A 字符可用來對齊多點鏈路中的所有信道。

完成 ILAS 后,TX 將通過串行信道發(fā)送有效用戶數(shù)據(jù)。

g.) 在 RX 內(nèi)部,每個信道都會在每個信道的彈性緩沖器中存儲 ILAS 序列的最后一個 A 字符以及緊跟其后的任何用戶數(shù)據(jù)。彈性緩沖器中用戶數(shù)據(jù)的釋放點通常是在檢測到每個信道彈性緩沖器中最后一個 A 字符后的下一個 LMFC 上升沿。接收到的用戶數(shù)據(jù)就像在 TX 側(cè)一樣,將需要通過傳輸層的背面,將串行位重新排列為有意義的并行樣片。

h.) 該信道對齊特性可確保來自每個信道的所有數(shù)據(jù)都可對齊。此外,它還可承受物理布局導(dǎo)致的任何信道偏移。這是在實現(xiàn)確定時延(該主題我將在以后的博客中介紹)過程中所使用的重要特性之一。

請關(guān)注我的下一篇博客文章《為您的信號鏈頻率計劃確定 JESD204B 鏈路參數(shù)》。

《轉(zhuǎn)換至 JESD204B 時您需要知道什么》(白皮書)

《JESD204B:適合您嗎?》(博客文章)

《高速數(shù)據(jù)轉(zhuǎn)換器中的 JESD204B 與 LVDS》(博客文章)

閱讀更多 JESD204B 博客

責任編輯:haq

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