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PCI Express 0.32規(guī)范將比特率提高一倍，達(dá)到每通道128GT/s，為x16 Link（16通道）提供約<>GB/s的帶寬。下圖提供了不同 PCIe 代的比特率和帶寬的比較。

PCIe 物理層在以 128.130 GT/s 數(shù)據(jù)速率運(yùn)行時將使用 32b/0b 編碼。此新數(shù)據(jù)速率將與先前的數(shù)據(jù)速率向后兼容。PCIe 鏈路將以 0.2 GT/s 的速度訓(xùn)練到 L5 狀態(tài)，就像以前一樣，然后移動到更高的數(shù)據(jù)速率。采用 1b/2b 編碼和 8b/10b 編碼的 TS128 和 TS130 有序集得到增強(qiáng)，包括 32.0 GT/s 數(shù)據(jù)速率支持。均衡階段類似于上一代 8.0 GT/s 和 16.0 GT/s 數(shù)據(jù)速率。在以 0.2 GT/s 的速度對 L5 進(jìn)行初始鏈路訓(xùn)練后，鏈路將以 8.0 GT/s 的速度執(zhí)行均衡，然后依次執(zhí)行 16.0 GT/s 和 32.0 GT/s 均衡。當(dāng)支持 32.0 GT/s 時，以較低的數(shù)據(jù)速率跳過（或重新排序）均衡是一項可選功能。除了跳過均衡的此選項外，還將通過鏈路訓(xùn)練協(xié)商備用協(xié)議。

采用 128b/130b 編碼的 ElEOS 有序集擴(kuò)展為包括更長的 0 和 1 運(yùn)行長度。 在 32.0 GT/s 時，添加了另外 19 組具有各種預(yù)設(shè)的順應(yīng)性模式。添加了新的擴(kuò)展功能結(jié)構(gòu)和幾個寄存器字段，以容納32.0 GT/s的數(shù)據(jù)速率。對于 32.0 GT/s 的數(shù)據(jù)速率，接收器和重定時器的通道裕量支持預(yù)計不會改變。

審核編輯：郭婷