準(zhǔn)備工作
PS模式首先要把Bitstream Generation中的
(1)JTAG模式選擇為Passive
(2)根據(jù)PS的位寬選擇相應(yīng)的Programming Mode.
(3)生成相應(yīng)的下載文件。注意修改Bitstream生成模式時(shí),不需要進(jìn)行工程的全編譯,只需運(yùn)行最后一步數(shù)據(jù)流生成即可。
PS配置啟動過程
這里以X1模式為例,PS的配置過程如下:
(1)在啟動配置之前要先把CRESET_N拉低tCRESET_N,然后拉高;
(2)在CRESET_N拉高之后,要等待tDMIN,才可以發(fā)送同步碼,這期間可以翻轉(zhuǎn)CCK;下面就是兩步碼。
(3)發(fā)送同步碼,數(shù)據(jù)與時(shí)鐘為上升沿觸發(fā);要求外部處理器連續(xù)發(fā)送數(shù)據(jù)直到數(shù)據(jù)完成;
(4)數(shù)據(jù)發(fā)送完成后,繼續(xù)發(fā)送CCK時(shí)鐘100周期,或者一邊發(fā)送一邊檢測CDONE,直到CDONE為高。實(shí)際上也確實(shí)有客戶因?yàn)闆]有拉時(shí)鐘而啟動不了的情況。
控制信號處理
易靈思Trion FPGA的配置模塊主要由CBUS[2:0]、SS_N和TEST_N,CSI幾個(gè)信號控制。FPGA進(jìn)入用戶模式前不要對這幾個(gè)信號進(jìn)行翻轉(zhuǎn)。
目前易靈思的Programmer工具只支持PS x1模式,所以如果實(shí)在找不配置失敗的原因,可以通過邏輯分析儀來分析數(shù)據(jù)差異。x2和更高位寬需要通過外部微處理器,如MCU來操作。
這里需要注意的是在配置過程中,控制信號不要進(jìn)行翻轉(zhuǎn),目前看到的現(xiàn)象是在多次配置過程中,在連續(xù)兩次配置過程中,由于CSI翻轉(zhuǎn)造成第二次配置失敗。
應(yīng)用案例
目前T20F169測試PS x4模式。時(shí)鐘為30MHz,tCRESET_N拉低790ns,tDMIN為2us,數(shù)據(jù)配置完成后又繼續(xù)發(fā)送時(shí)鐘100個(gè)以上??梢詥印S脮r(shí)104ms
另外要提下數(shù)據(jù)順序問題,實(shí)際在發(fā)送過程是依次發(fā)送的。且第個(gè)字節(jié)從高位先發(fā)送。
整體配置過程波形如下,SS_N有時(shí)會有很多毛刺,時(shí)鐘之間也會有一些持續(xù)拉高的時(shí)間,但都不影響 。
審核編輯:湯梓紅
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原文標(biāo)題:易靈思Trion FPGA PS配置模式--update(4)
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