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聚洵Gainsil【電平轉(zhuǎn)換評估板-GS0104】

聚洵半導(dǎo)體科技 ? 2023-06-22 10:14 ? 次閱讀

電平轉(zhuǎn)換(Level Shift)與電源系統(tǒng)中的電壓轉(zhuǎn)換是兩種不同功能的芯片,電平轉(zhuǎn)換是針對信號線電平的,比如MCU 的GPIO口為3.3V的工作電壓,DSP的GPIO是1.8V,它們之間的通信就不能直接相連,需要做電平適配上處理才能通信。聚洵Gainsil此系列產(chǎn)品可以適用于1.2V~5.5V的工作電壓,尤其可支持低壓最低1.2V,相比市場上同類產(chǎn)品有更加廣泛的應(yīng)用場景。

GS0104電平轉(zhuǎn)換評估板

81a4286e-10a2-11ee-a579-dac502259ad0.jpg

01

GS0104電平轉(zhuǎn)換評估板介紹

81cc8886-10a2-11ee-a579-dac502259ad0.png

GS0104評估板原理圖

通過電壓電平轉(zhuǎn)接芯片實(shí)現(xiàn):

GS0104電壓電平轉(zhuǎn)換芯片提供四路數(shù)據(jù)線,主要用于UART、I2C、SMBus、GPIO等通信接口,自動識別方向,兼容推挽輸出架構(gòu)和開漏輸出架構(gòu),其主要特點(diǎn)如下:

● 無需數(shù)據(jù)方向控制;

●推挽架構(gòu)(Push-Pull)支持24Mbps數(shù)據(jù)速率,開漏架構(gòu)(Open-Drain)支持2Mbps數(shù)據(jù)速率;

●A側(cè)支持1.2V~5.5V,B側(cè)支持1.2V~5.5V;

● A、B側(cè)電源互相隔離;

● 無上電時(shí)序要求;

● 支持-40°C~+85°C。

需要注意VCCA的供電電壓不能大于VCCB,即A側(cè)接到低電壓系統(tǒng),B側(cè)接到高電壓系統(tǒng)。

輸入電源:

VDD5V,固定為5V。

VCCA,根據(jù)選擇的輸入信號設(shè)置,如1.2V,1.8V,2.5V,3.3V,5V。

VCCB,設(shè)置為VCCA ~ 5.5V。

輸入信號:

輸入信號設(shè)置為0~3.3V峰峰值的方波,頻率不固定。

待測芯片的輸入信號:

81f7c9c4-10a2-11ee-a579-dac502259ad0.png

02

評估板測試方法及測試步驟

1、tPHL/tPLHAtoB

?a. VDD5V:設(shè)置為5V,輸入信號設(shè)置為0 ~ 3.3V方波,頻率設(shè)置為1MHz;

b. VCCA:根據(jù)選擇的輸入信號設(shè)置,如1.2V,1.8V,2.5V,3.3V,5V;

c. VCCB:設(shè)置為VCCA ~ 5.5V;

d. 插上跳線帽OEH;

e. 插上輸入引腳JAn跳線帽;

f. 示波器帶寬限制設(shè)置為關(guān)閉,測試輸入和輸出引腳的傳輸延遲時(shí)間;

2、tPHL/tPLHB to A

a. VDD5V:設(shè)置為5V,輸入信號設(shè)置為0 ~ 3.3V方波,頻率設(shè)置為1MHz;

b. VCCB:根據(jù)選擇的輸入信號設(shè)置,如1.2V,1.8V,2.5V,3.3V,5V;

c. VCCA:設(shè)置為1.2V ~ VCCB;

d. 插上跳線帽O(jiān)EH;

e. 插上輸入引腳JBn跳線帽;

f. 示波器帶寬限制設(shè)置為關(guān)閉,測試輸入和輸出引腳的傳輸延遲時(shí)間;

3、ten

a. VDD5V:設(shè)置為5V,輸入信號設(shè)置為0 ~ 3.3V方波,頻率設(shè)置為1MHz;

b. VCCA:根據(jù)選擇的輸入信號設(shè)置,如1.2V,1.8V,2.5V,3.3V,5V;

c. VCCB:設(shè)置為VCCA ~ 5.5V;

d. 插上跳線帽J11、JOE;

e. 示波器帶寬限制設(shè)置為關(guān)閉,設(shè)置為上升沿觸發(fā),測試輸入OE和輸出引腳B1的傳輸延遲時(shí)間即為ten;

4、tdis

a. VDD5V:設(shè)置為5V,輸入信號設(shè)置為0 ~ 3.3V方波,頻率設(shè)置為1MHz;

b. VCCA:根據(jù)選擇的輸入信號設(shè)置,如1.2V,1.8V,2.5V,3.3V,5V;

c. VCCB:設(shè)置為VCCA ~ 5.5V;

d. 插上跳線帽J11、J12、JOE;

e. 示波器帶寬限制設(shè)置為關(guān)閉,設(shè)置為下降沿觸發(fā),測試輸入OE和輸出引腳B1的傳輸延遲時(shí)間即為tdis

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