0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
創(chuàng)作中心

完善資料讓更多小伙伴認(rèn)識你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

使用ANSI C代碼實現(xiàn)RISC-V CPU內(nèi)核

CHANBAEK ? 來源: FunIO ? 作者: FunIO ? 2023-07-23 11:02 ? 次閱讀

今天在 GitHub 上看到一個 C 語言項目,用大約 600 行代碼實現(xiàn)了一個 RISC-V CPU 核,甚為感嘆,分享一下。不管是學(xué)習(xí) C,還是學(xué)習(xí) RISC-V,這個項目都有非常高的學(xué)習(xí)價值,開源萬歲!

rv

用 ANSI C 編寫的 RISC-V CPU 內(nèi)核。

特征:

  • RV32IMC 用戶級實現(xiàn)
  • 通過 riscv 測試中所有支持的測試
  • ~600 行代碼
  • 不使用任何大于 32 位的整數(shù)類型,即使對于乘法也是如此
  • 簡單 API(兩個函數(shù),加上您提供的兩個內(nèi)存回調(diào)函數(shù))
  • 無內(nèi)存分配

應(yīng)用程序接口

/* Memory access callbacks: data is input/output, return RV_BAD on fault, 0 otherwise */
typedef rv_res (*rv_store_cb)(void *user, rv_u32 addr, rv_u8 data);
typedef rv_res (*rv_load_cb)(void *user, rv_u32 addr, rv_u8 *data);

/* Initialize CPU. */
void rv_init(rv *cpu, void *user, rv_load_cb load_cb, rv_store_cb store_cb);

/* Single-step CPU. Returns 0 on success, one of RV_E* on exception. */
rv_u32 rv_step(rv *cpu);

用法

#include < stdio.h >
#include < string.h >

#include "rv.h"

rv_res load_cb(void *user, rv_u32 addr, rv_u8 *data) {
  if (addr - 0x80000000 > 0x10000) /* Reset vector is 0x80000000 */
    return RV_BAD;
  *data = ((rv_u8 *)(user))[addr - 0x80000000];
  return RV_OK;
}

rv_res store_cb(void *user, rv_u32 addr, rv_u8 data) {
  if (addr - 0x80000000 > 0x10000)
    return RV_BAD;
  ((rv_u8 *)(user))[addr - 0x80000000] = data;
  return RV_OK;
}

rv_u32 program[2] = {
    /* _start: */
    0x02A88893, /* add a7, a7, 42 */
    0x00000073  /* ecall */
};

int main(void) {
  rv_u8 mem[0x10000];
  rv cpu;
  rv_init(&cpu, (void *)mem, &load_cb, &store_cb);
  memcpy((void *)mem, (void *)program, sizeof(program));
  while (rv_step(&cpu) != RV_EECALL) {
  }
  printf("Environment call @ %08X: %un", cpu.pc, cpu.r[17]);
  return 0;
}

rv編譯程序

使用 riscv-gnu-toolchain工具鏈和 rv 鏈接腳本 。

建議使用gcc命令行:

riscv64-unknown-elf-gcc example.S -nostdlib -nostartfiles -Tlink.ld -march=rv32imc -mabi=ilp32 -o example.o -e _start -g -no-pie

然后用 obj 工具將0x80000000起始的二進(jìn)制代碼生成能被rv加載的二進(jìn)制文件:

riscv64-unknown-elf-objcopy -g -O binary example.o example.bin

支持的指令列表

參見 支持指令列表。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
  • 內(nèi)核
    +關(guān)注

    關(guān)注

    3

    文章

    1336

    瀏覽量

    40084
  • cpu
    cpu
    +關(guān)注

    關(guān)注

    68

    文章

    10702

    瀏覽量

    209383
  • ANSI
    +關(guān)注

    關(guān)注

    0

    文章

    28

    瀏覽量

    20500
  • C代碼
    +關(guān)注

    關(guān)注

    1

    文章

    89

    瀏覽量

    14237
  • RISC-V
    +關(guān)注

    關(guān)注

    44

    文章

    2141

    瀏覽量

    45711
收藏 人收藏

    評論

    相關(guān)推薦

    64位RISC-V CPU發(fā)展現(xiàn)狀和未來前景

    RISC-V CPU發(fā)展情況 實際上,目前RISC-V已經(jīng)開始64位CPU的研發(fā),也已經(jīng)有相關(guān)內(nèi)核和產(chǎn)品面市,比如平頭哥64位
    的頭像 發(fā)表于 07-22 07:59 ?3903次閱讀

    瑞薩電子推出64位RISC-V CPU內(nèi)核RZ/Five通用MPU,開創(chuàng)RISC-V技術(shù)先河

    瑞薩電子今日宣布,推出基于64位RISC-V CPU內(nèi)核的RZ/Five通用微處理器(MPU)——RZ/Five采用Andes AX45MP,基于RISC-V
    發(fā)表于 03-01 13:54 ?1350次閱讀
    瑞薩電子推出64位<b class='flag-5'>RISC-V</b> <b class='flag-5'>CPU</b><b class='flag-5'>內(nèi)核</b>RZ/Five通用MPU,開創(chuàng)<b class='flag-5'>RISC-V</b>技術(shù)先河

    瑞薩電子推出采用自研RISC-V CPU內(nèi)核的通用32位MCU

    2024 年 3 月 26 日,中國北京訊 - 全球半導(dǎo)體解決方案供應(yīng)商瑞薩電子(TSE:6723)今日宣布率先在業(yè)內(nèi)推出基于內(nèi)部自研CPU內(nèi)核構(gòu)建的通用32位RISC-V微控制器(MCU
    發(fā)表于 03-30 22:08

    為什么選擇RISC-V?

    。例如,如果工程師在FPGA中實現(xiàn)RISC-V內(nèi)核,則通常可以使用RTL源代碼。由于RISC-V免版稅,這為將基于
    發(fā)表于 07-27 17:38

    RISC-V MCU開發(fā) (一):集成開發(fā)環(huán)境

    近年來,RISC-V生態(tài)獲得了空前的繁榮發(fā)展,國內(nèi)外眾多科技公司紛紛下場布局、行業(yè)應(yīng)用層出不窮,搭載RISC-V內(nèi)核的MCU也逐漸走入了工程師的日常開發(fā)工作中。 工欲善其事必先利其器,要想實現(xiàn)
    發(fā)表于 09-22 14:44

    如何實現(xiàn)一個RISC-V內(nèi)核架構(gòu)的芯片移植工作

    使用 common 文件夾中的任務(wù)切換代碼RT-Thread RISC-V 內(nèi)核移植 API 實現(xiàn)內(nèi)核移植的主要工作內(nèi)容,主要就是
    發(fā)表于 03-25 10:11

    RISC-V基礎(chǔ)知識:模塊化開放式的ISA CISC和RISC代碼區(qū)別

    /ti/)TIonal— 一個開放的 ISARISC-V是一種開放式指令集架構(gòu)(ISA),這意味著您可以自由地在微處理器或微控制器中實現(xiàn)RISC-V CPU,而無需向任何人支付使用此I
    發(fā)表于 12-23 17:51

    RISC-V中國峰會:RISC-V產(chǎn)業(yè)及生態(tài)發(fā)展

    RISC-V中國峰會:RISC-V產(chǎn)業(yè)及生態(tài)發(fā)展,CPU創(chuàng)新應(yīng)用,能為大眾所用。
    的頭像 發(fā)表于 06-22 11:28 ?2856次閱讀
    <b class='flag-5'>RISC-V</b>中國峰會:<b class='flag-5'>RISC-V</b>產(chǎn)業(yè)及生態(tài)發(fā)展

    第一屆RISC-V中國峰會看點 risc-v開發(fā)要怎么優(yōu)化risc-v指令集架構(gòu)代碼密度

    在第一屆RISC-V中國峰會上看點很多,RISC-V是開源的,那么代碼密度要怎么控制,會不會因為開源而導(dǎo)致代碼密度特別大? 我們一起來看看risc-
    發(fā)表于 06-23 18:22 ?9589次閱讀
    第一屆<b class='flag-5'>RISC-V</b>中國峰會看點 <b class='flag-5'>risc-v</b>開發(fā)要怎么優(yōu)化<b class='flag-5'>risc-v</b>指令集架構(gòu)<b class='flag-5'>代碼</b>密度

    RISC-V MCU開發(fā) (六):代碼下載

    、CH58x、CH32Fx、CH32Vx等RISC-V/ARM內(nèi)核MCU工程的代碼下載功能。其中,對于CH56x、CH57x、CH58x等型號,MRS還支持關(guān)閉兩線仿真調(diào)試接口功能;對于CH32Fx、CH32Vx型號,MRS支持
    發(fā)表于 12-02 09:06 ?11次下載
    <b class='flag-5'>RISC-V</b> MCU開發(fā) (六):<b class='flag-5'>代碼</b>下載

    RISC-V CPU調(diào)試機(jī)制的設(shè)計原理

    本文將詳細(xì)介紹RISC-V CPU調(diào)試機(jī)制的設(shè)計原理。
    發(fā)表于 10-18 09:19 ?2048次閱讀

    TenstorrentInc首席CPU構(gòu)架師 練維漢:助力數(shù)字化升級的RISC-V AI 高性能CPU

    ”,曾在水果公司作CPU的架構(gòu)設(shè)計師。練維漢除介紹RISC-V內(nèi)核的高性能 CPU IP內(nèi)核技術(shù)之外,也對近期熱門的
    的頭像 發(fā)表于 08-28 12:05 ?3315次閱讀
    TenstorrentInc首席<b class='flag-5'>CPU</b>構(gòu)架師 練維漢:助力數(shù)字化升級的<b class='flag-5'>RISC-V</b> AI 高性能<b class='flag-5'>CPU</b>

    內(nèi)核架構(gòu)意義凸顯,RISC-V現(xiàn)新機(jī).zip

    內(nèi)核架構(gòu)意義凸顯,RISC-V現(xiàn)新機(jī)
    發(fā)表于 01-13 09:06 ?2次下載

    新聞快訊 | 瑞薩推出第一代32位RISC-V CPU內(nèi)核

    新聞快訊 全球半導(dǎo)體解決方案供應(yīng)商瑞薩電子(TSE:6723)宣布成功設(shè)計、測試并推出基于開放標(biāo)準(zhǔn)RISC-V指令集架構(gòu)(ISA)的32位CPU內(nèi)核。瑞薩作為業(yè)內(nèi)首個為32位通用RISC-V
    的頭像 發(fā)表于 12-08 11:40 ?438次閱讀

    瑞薩推出采用自研CPU內(nèi)核的通用32位RISC-V MCU 加強(qiáng)RISC-V生態(tài)系統(tǒng)布局

    瑞薩推出采用自研CPU內(nèi)核的通用32位RISC-V MCU 加強(qiáng)RISC-V生態(tài)系統(tǒng)布局 RISC-V MCU為開發(fā)人員帶來低功耗、高性能的
    發(fā)表于 03-28 19:00 ?391次閱讀