Vitis Unified IDE 和通用命令行參考手冊

AMD Vitis Unified IDE 是用于為 AMD 自適應(yīng) SoC 和 FPGA 器件開發(fā)應(yīng)用的設(shè)計環(huán)境。它集成了 Vitis IDE、Vitis HLS 和 Vitis Analyzer 的功能。此統(tǒng)一 IDE 為端到端的應(yīng)用開發(fā)提供了單一工具，無需在多個設(shè)計、調(diào)試、集成和分析 工具之間反復(fù)跳轉(zhuǎn)。您可利用 Vitis Unified IDE 來執(zhí)行多項任務(wù)，同時其具有諸多優(yōu)勢。

本文檔旨在逐步指導(dǎo)您熟悉各種 Vitis 工具，這些工具采用自下而上的設(shè)計流程來開發(fā)系統(tǒng)組件，隨后將其集成到頂層系統(tǒng)工程中。

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您可利用 Vitis Unified IDE 來執(zhí)行多項任務(wù)

• 開發(fā)嵌入式應(yīng)用，可在包括 AMD Versal 和 AMD Zynq UltraScale+ MPSoC 器件在內(nèi)的自適應(yīng) SoC 處理器上運行

• 為 Versal 自適應(yīng) SoC 開發(fā) AI 引擎應(yīng)用與內(nèi)核

• 通過創(chuàng)建 HLS 組件，利用 C/C++ 設(shè)計可編程邏輯

• 為 AMD Alveo 數(shù)據(jù)中心加速器卡和自適應(yīng) SoC 器件開發(fā)系統(tǒng)工程

Vitis Unified IDE 具有如下優(yōu)勢

安裝簡單

相比于完整版本，它對于網(wǎng)絡(luò)和硬盤的壓力更?。磺度胧桨姹鞠螺d大小從 50 GB 減小到 10 GB，安裝大小從 166 GB 減小到 15 GB

降低安裝依賴要求：命令行服務(wù)器不再依靠 GUI 庫

安裝改良

構(gòu)架易用：

“Flow Navigator”可幫助您管理不同設(shè)計的工作流程

設(shè)計流程支持模板樣本，以便新用戶查看所有可用示例，從而提升生產(chǎn)力

非阻塞命令現(xiàn)在可同時運行多項構(gòu)建和分析作業(yè)

面向 AI 引擎工作流程的設(shè)計增強功能

軟件仿真會在 x86 模式下運行主機應(yīng)用以加速設(shè)計迭代，因為無需利用 Linux 操作系統(tǒng)啟動 QEMU

AI 引擎流水線視圖已從單核增強至多核；您可為任意活動的核選擇流水線視圖

AI 引擎微代碼視圖已增強，包含用戶可選的篩選器

現(xiàn)代化的外觀和框架

亮色主題和暗色主題

利用可安全自定義的快捷鍵進行快速操作

用戶友好的命令選用板

最新 C++ 語法高亮和 IntelliSense

易用性

在 GUI 模式與命令行 (CLI) 模式之間輕松切換

將 GUI 與 CLI 各自的優(yōu)勢合而為一

實時呈現(xiàn)配置文件

CLI 可用于構(gòu)建工程，并構(gòu)建統(tǒng)一 IDE 用于調(diào)試核分析

GUI 操作保存在 python log 日志中用于批量重建

本文檔旨在逐步指導(dǎo)您熟悉各種 Vitis 工具，這些工具采用了 Vitis Unified IDE 和全新的 v++ 命令行流程來開發(fā) AI 引擎組件、HLS 組件和系統(tǒng)工程。

單一統(tǒng)一的設(shè)計環(huán)境可以提供所有必要的功能特性，用于編譯、運行、調(diào)試和分析 FPGA 加速的數(shù)據(jù)中心應(yīng)用或異構(gòu)嵌入式系統(tǒng)設(shè)計的不同元素。Vitis 統(tǒng)一 IDE 支持您執(zhí)行下列操作：使用 Versal 器件的超長指令字 (VLIW) 處理器陣列來創(chuàng)建 AI 引擎組件；使用 HLS 組件將 C/C++ 代碼綜合到 RTL 設(shè)計中，運行 C 語言仿真和 C/RTL 協(xié)同仿真；在全新集成的 Vitis Analyzer 分析器工具中復(fù)查和分析構(gòu)建和運行匯總信息。

全新的 Vitis IDE 能搭配 v++ 命令和 vitis-run 命令的全新命令行功能特性一起使用。無論是使用命令行還是 Vitis IDE 來工作，您都能利用單一環(huán)境所提供的緊密集成的設(shè)計環(huán)境來完成大部分設(shè)計目標(biāo)。

Vitis Unified IDE 當(dāng)前正處于預(yù)覽階段，適用對象包括數(shù)據(jù)中心加速和嵌入式系統(tǒng)設(shè)計、AI 引擎和 HLS 組件創(chuàng)建、平 臺創(chuàng)建以及嵌入式軟件設(shè)計。

文章導(dǎo)航

第 1 章：簡介

第 2 章：安裝和啟動 Vitis Unified IDE

第 3 章：構(gòu)建和運行 AI 引擎組件

第 4 章：構(gòu)建和運行 HLS 組件

第 5 章：創(chuàng)建應(yīng)用組件

第 6 章：創(chuàng)建平臺組件

第 7 章：嵌入式軟件開發(fā)流程

第 8 章：為異構(gòu)計算創(chuàng)建系統(tǒng)工程

第 9 章：使用“Analysis”視圖（Vitis Analyzer）

第 10 章：使用 Vitis Unified IDE

第 11 章：命令行流程

第 12 章：命令參考

第 13 章：從現(xiàn)有工具轉(zhuǎn)移

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