晶體管是怎么做得越來(lái)越小的？

上次我的文章解釋了所謂的7nm不是真的7nm，是在實(shí)際線寬無(wú)法大幅縮小的前提下，通過(guò)改變晶體管結(jié)構(gòu)的方式縮小晶體管實(shí)際尺寸來(lái)達(dá)到等效線寬的效果

那么新的問(wèn)題來(lái)了：從平面晶體管結(jié)構(gòu)(Planar)到立體的FinFET結(jié)構(gòu)，我們比較容易理解晶體管尺寸縮小的原理。如下圖所示：

那么從20nm開(kāi)始到3nm，晶體管的結(jié)構(gòu)都是FinFET的。結(jié)構(gòu)沒(méi)有變化的條件下，晶體管尺寸是如何縮小那么多的呢？

之前網(wǎng)絡(luò)上的解釋是：某公司的7nm技術(shù)是采用了多重曝光方法以后提升了分辨率

其實(shí)這種說(shuō)法是錯(cuò)誤的，或者說(shuō)至少是有很大誤導(dǎo)性的

多重曝光技術(shù)是現(xiàn)代先進(jìn)半導(dǎo)體工藝?yán)锏囊粋€(gè)通用技術(shù)了，如果我沒(méi)有記錯(cuò)，從32nm或者28nm工藝節(jié)點(diǎn)開(kāi)始，多重曝光技術(shù)就已經(jīng)被應(yīng)用了

所以從14nm到7nm工藝，如果不是用EUV替代DUV，那現(xiàn)有的光刻技術(shù)是無(wú)法大幅度降低現(xiàn)況的。也就是說(shuō)，要縮小晶體管的尺寸，必須另找辦法

微縮晶體管的尺寸的方法不少，各家都有自己的絕活和妙招，我這里講幾個(gè)常用的方法

首先，一個(gè)CMOS晶體管里無(wú)論是P管還是N管，它的鰭片(Fin)的數(shù)量一定不止一個(gè)。因?yàn)閱蝹€(gè)Fin太細(xì)，通過(guò)的電流不夠大，所以需要多個(gè)Fin并聯(lián)來(lái)提高電流

在Fin的間距不變的情況下，F(xiàn)in的數(shù)量就決定了晶體管的高度。所以行業(yè)里要縮小晶體管的尺寸，就是盡量減少每個(gè)MOS管里需要的Fin的數(shù)量

由下圖可知，從左到右，晶體管的鰭片數(shù)量從4個(gè)減少到3個(gè)，然后是2個(gè)。這樣整個(gè)晶體管的面積就大幅縮小了。從20nm一直到5nm甚至3nm，這個(gè)數(shù)量一直在減少（當(dāng)然，通過(guò)采用EUV和多重曝光技術(shù)，F(xiàn)in的間距也是同時(shí)在不斷縮?。?/p>

上圖里Track這個(gè)詞是衡量晶體管高度的一個(gè)單位。它實(shí)際上是第1、2層金屬層里最細(xì)的連線的間距大小。一個(gè)間距大小就是一個(gè)Track，晶體管高度是連線間距的幾倍，就叫幾個(gè)Tracks

金屬連線的間距值MxP和柵極線條最小間距CPP值（上圖里豎直方向的紅色線條）就基本反映了圖形加工工藝的水平，也決定了晶體管的大小

詳細(xì)說(shuō)明見(jiàn)我文章：關(guān)于芯片的7nm到底是個(gè)啥，我得繼續(xù)講講

另外，還有一個(gè)比較巧妙的路徑就是：如果不能縮小晶體管的面積，那我們也可以縮小晶體管之間的間隔空間來(lái)實(shí)現(xiàn)密度提升啊

晶體管之間要做電性能隔離，一般都是用擴(kuò)散層實(shí)現(xiàn)的，這個(gè)叫Diffusion Breaks。原本每個(gè)晶體管各自有一個(gè)隔離帶，叫DDB(Double Diffusion Breaks)，現(xiàn)在為了節(jié)約空間，只用一個(gè)隔離帶了，叫SDB(Single Diffusion Breaks)

就好比你家院子和鄰居院子如果各修一個(gè)籬笆，自然會(huì)占用更多土地面積。于是你們兩家商量一下，想辦法合建一個(gè)籬笆來(lái)隔離，自然就能多出一些空間來(lái)

下面兩張圖分別是DDB和SDB的俯視圖和橫截面示意圖，大家看了自然就會(huì)明白

另外，Intel家還在很早就開(kāi)發(fā)了一種叫COAG(Contact Over Active Gate)的技術(shù)。原本需要在空白地方制作柵極接觸點(diǎn)會(huì)占用額外的空間，所以Intel想辦法把接觸點(diǎn)的位置直接做到了柵極的上面，就可以節(jié)約大量空間。如下圖所示：

這個(gè)想法當(dāng)然是非常絕妙的。但可惜的是，由于各種原因，這個(gè)技術(shù)的良率一直做不好，直接影響了Intel先進(jìn)工藝的開(kāi)發(fā)進(jìn)度。這也是他家工藝逐漸被臺(tái)積電和三星趕上并超越的重要原因之一吧

以上就是幾個(gè)縮小晶體管尺寸的常用技術(shù)方案了。其實(shí)還有其它很多微縮的方法，比如用金屬鈷(Co)代替銅，用空腔代替?zhèn)鹘y(tǒng)金屬連線介電層等方案來(lái)縮小BEOL段的金屬連線尺寸的方法。限于篇幅，我這里就不展開(kāi)講了

不管如何，怎么樣？上面這張表里紅框部分的內(nèi)容你是不是一下就看懂了？瞬間覺(jué)得自己長(zhǎng)知識(shí)了的感覺(jué)有沒(méi)有？

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