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MOSFET電路柵源極GS之間為什么需要并聯(lián)一個電容?居然能解決MOS誤導(dǎo)通的問題?

硬件那點(diǎn)事兒 ? 來源:硬件那點(diǎn)事兒 ? 作者:硬件那點(diǎn)事兒 ? 2024-11-12 11:12 ? 次閱讀

Part 01

前言

MOSFET中,dv/dt指的是MOSFET在開關(guān)瞬態(tài)期間,其漏源電壓Vds的變化率,即漏極和源極之間電壓隨時間的變化速度。一般想到dv/dt,我們第一反應(yīng)是高dv/dt會導(dǎo)致強(qiáng)烈的電磁干擾,影響周圍的敏感電路,降低系統(tǒng)的信號完整性。除此之外高dv/dt還會產(chǎn)生另外一大危害,那就是如果dv/dt過高,漏源電壓的快速變化會通過柵-漏電容Cgd耦合到柵極電壓Vgs,導(dǎo)致柵極電壓瞬時上升,從而使MOSFET在關(guān)閉的情況下誤導(dǎo)通。接下來我們就介紹一下原因以及應(yīng)對方法。

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Part 02

MOS誤導(dǎo)通的原因

我們以DCDC電路為例,比如同步開關(guān)電源,其拓?fù)潆娐?,一般是使用一組MOSFET作為上管和下管來分時開關(guān)實(shí)現(xiàn)穩(wěn)壓輸出。當(dāng)MOSFET高速開關(guān)時,MOSFET由導(dǎo)通切換到關(guān)斷狀態(tài)下,MOSFET的漏極和源極端子之間會產(chǎn)生快速上升的電壓Vds。開關(guān)頻率越高,對應(yīng)的漏極和源極電壓隨時間的變化:dv/dt會越大,根據(jù)MOSFET的柵-漏極電容Cgd和柵-源極電容Cgs之間的比值會在MOS的G-S直接形成一個分壓,或通過Cds流向柵極電阻R的電流會在柵極電阻兩端形成一個分壓,當(dāng)此分壓大于柵極開啟電壓時就會導(dǎo)致MOSFET自導(dǎo)通。

wKgZoWcyyDqAR69cAAELCI2zJpA985.png

為了便于理解,我們分別分析以下兩種MOS誤導(dǎo)通模型:

模型1:不考慮外部柵極電阻

此模型相當(dāng)于MOS的柵極懸空

此時相當(dāng)于Cgd和Cgs兩個寄生電容串聯(lián)接在Vds之間:

那么感應(yīng)電壓Vgs=Vds*Cgd/(Cgd+Cgs)

只有當(dāng)Vds*Cgd/(Cgd+Cgs)

Vgth:MOS的開啟電壓

wKgZoWcyyDqACt45AACZqtoBUdY731.png

模型2:考慮外部柵極電阻

此模型相當(dāng)于MOS的柵極接驅(qū)動器,驅(qū)動器輸出低(我們假設(shè)驅(qū)動器輸出低時的導(dǎo)通電阻為0)

此時相當(dāng)于Cgd和Rg,i串聯(lián)后接在Vds之間:

那么流經(jīng)Cgd的電流為Igd=Cgd*dv/dt

柵極電壓感應(yīng)電壓Vgs=Igd*Rg,i=Rg,i*Cgd*dv/dt

只有當(dāng)Rg,i*Cgd*dv/dt

Vgth:MOS的開啟電壓

wKgZoWcyyDqAD6CxAABzKxORtuI051.png

Part 03

如何解決MOS誤導(dǎo)通的問題?

基于模型1:感應(yīng)電壓Vgs=Vds*Cgd/(Cgd+Cgs)

我們可以通過在MOS柵源極并聯(lián)電容來增大Cgs,這樣相當(dāng)于變相減小了Vgs,從而解決MOS誤導(dǎo)通的問題。

2.基于模型2:感應(yīng)電壓Vgs=Rg,i*Cgd*dv/dt

可以通過限制dv/dt來解決此問題,如何限制dv/dt呢?可以在MOS柵極串聯(lián)電阻Rg來降低MOSFET的開關(guān)速率,進(jìn)而降低dv/dt。

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