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MCU健壯性設(shè)計(jì)之CAN時(shí)鐘

電子工程師 ? 來(lái)源:未知 ? 作者:龔婷 ? 2018-03-09 13:59 ? 次閱讀

在一個(gè)CAN網(wǎng)絡(luò)中,如果希望有良好的讀位,那么采樣點(diǎn)的時(shí)間位置相對(duì)來(lái)說(shuō)是非常重要的。因此,所有的網(wǎng)絡(luò)節(jié)點(diǎn)都有質(zhì)量時(shí)鐘。然而,石英和諧振器有公差,會(huì)隨著溫度和時(shí)間漂移。只要變量保持在一個(gè)公差范圍內(nèi),協(xié)議管理器就可以補(bǔ)償錯(cuò)誤。

CAN協(xié)議的建議要求對(duì)時(shí)鐘頻率最大限度的最大限度地容忍1.58%。

在這種情況下,建議直接使用石英或諧振器的時(shí)鐘,而不是由PLL產(chǎn)生的系統(tǒng)時(shí)鐘。實(shí)際上,PLL(抖動(dòng))的頻率變化是無(wú)法滿(mǎn)足要求的精度的。

根據(jù)μC的類(lèi)型,它可能會(huì)導(dǎo)致改變石英頻率以獲得網(wǎng)絡(luò)排放的愿望。讓我們以一個(gè)可以使用500 kbit/s波特率的網(wǎng)絡(luò)為例,在這種情況下,CAN總線的頻率必須在8MHz上配置。

在圖30的結(jié)構(gòu)中,4MHz的quartz足以滿(mǎn)足選擇的PLL(x2)。另一方面,通過(guò)避免PLL,16MHz的石英是必要的

在圖31的結(jié)構(gòu)中,沒(méi)有PLL的連接是直接的。在這種情況下,可以保留8MHz的石英。

PLL穩(wěn)定性(jitter)的總線通信(特別是高速CAN、FlexRay.)應(yīng)用中被考慮到。

聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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原文標(biāo)題:MCU健壯性設(shè)計(jì)之CAN時(shí)鐘

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