用于系統(tǒng)生成器中Vivado HLS IP模塊介紹
DSP? 的系統(tǒng)生成器是業(yè)界領(lǐng)先的架構(gòu)級(jí)*設(shè)計(jì)工具，可在 Xilinx 器件上定義、測(cè)試并實(shí)現(xiàn)高性能 DSP 算法。DSP 的系統(tǒng)生成器按照 Simulink? 的附加工具套件精心設(shè)計(jì)，可充分利用針對(duì) FPGA 架構(gòu)優(yōu)化的預(yù)先存在的 IP，其可由用戶進(jìn)行參數(shù)化，達(dá)到算法的質(zhì)量及成本目標(biāo)。與傳統(tǒng) RTL 開發(fā)時(shí)間相比，DSP 系統(tǒng)生成器的特性加上 Simulink? 提供的豐富仿真及驗(yàn)證環(huán)境的優(yōu)勢(shì)，只需一小部分時(shí)間就能創(chuàng)建生產(chǎn)質(zhì)量級(jí)的 DSP 算法。
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