鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核之EPCS的理論實(shí)戰(zhàn)講解
EPCS是串行存儲(chǔ)器，NiosII 不能直接從EPCS中執(zhí)行程序，它實(shí)際上是執(zhí)行EPCS控制器的片內(nèi)ROM中的代碼（即Bootloader），把EPCS中的程序搬到RAM中執(zhí)行。
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鋯石FPGA A4_Nano開發(fā)板視頻：AD IP核的定制
利用IP核設(shè)計(jì)電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán)，盡管IP
鋯石FPGA A4_Nano開發(fā)板視頻：LED的IP核應(yīng)用
利用IP核設(shè)計(jì)電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán)，盡管IP
鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核SPI的應(yīng)用實(shí)例講解
轉(zhuǎn)載自鋯石科技。
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鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核JTAG-UART的講解
JTAG UART是要自己添加的一個(gè)IP核，通常用來(lái)是實(shí)現(xiàn)PC和Nios II系統(tǒng)間的串行通信接口，它用于字符的輸入輸出，在Nios II的開發(fā)調(diào)試過(guò)程中扮演了重要的角色。
鋯石FPGA A4_Nano開發(fā)板視頻：VGA外設(shè)的IP核的應(yīng)用
調(diào)用IP核能避免重復(fù)勞動(dòng)，大大減輕工程師的負(fù)擔(dān)，因此使用IP核是一個(gè)發(fā)展趨勢(shì)，IP核的重用大大縮短了產(chǎn)品上市時(shí)間。
鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核之Interval Timer的應(yīng)用實(shí)戰(zhàn)講解
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鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核之PIO的實(shí)戰(zhàn)應(yīng)用講解
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鋯石FPGA A4_Nano開發(fā)板視頻：內(nèi)置IP核SDRAM的理論實(shí)戰(zhàn)講解
SDRAM在計(jì)算機(jī)中被廣泛使用，從起初的SDRAM到之后一代的DDR（或稱DDR1），然后是DDR2和DDR3進(jìn)入大眾市場(chǎng)，2015年開始DDR4進(jìn)入消費(fèi)市場(chǎng)。
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