FPGA之計(jì)數(shù)器的使用
計(jì)數(shù)器不僅能用于對(duì)時(shí)鐘脈沖計(jì)數(shù)，還可以用于分頻、定時(shí)、產(chǎn)生節(jié)拍脈沖和脈沖序列以及進(jìn)行數(shù)字運(yùn)算等。但是并無法顯示計(jì)算結(jié)果，一般都是要通過外接LCD或LED屏才能顯示。
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在數(shù)字電子產(chǎn)品中，計(jì)數(shù)器是由一系列觸發(fā)器組成的時(shí)序邏輯電路。顧名思義，計(jì)數(shù)器用于計(jì)算輸入在負(fù)或正邊沿轉(zhuǎn)換中出現(xiàn)的次數(shù)。根據(jù)觸發(fā)觸發(fā)器的方式，計(jì)數(shù)器
時(shí)序邏輯電路設(shè)計(jì)之計(jì)數(shù)器
前面已經(jīng)學(xué)習(xí)了時(shí)序邏輯電路中的基本單元：觸發(fā)器，這次就用其來整點(diǎn)活，實(shí)現(xiàn)計(jì)數(shù)器的設(shè)計(jì)，計(jì)數(shù)器可以說是任何和時(shí)序有關(guān)的設(shè)計(jì)都會(huì)用到他。
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