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      ZYNQ

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      AD936x RF收發(fā)器應(yīng)用相關(guān)問答

      AD9361是一款針對各種低功耗無線應(yīng)用而設(shè)計的RF收發(fā)器，集RF前端與靈活的混合信號基帶部分為一體....
      的頭像 ZYNQ 發(fā)表于 11-05 16:29 ?107次閱讀

      FPGA延時Verilog HDL實現(xiàn)

      可以在任意時刻啟動，可以重復(fù)啟動，延時時長可調(diào)，單位可切換（ms/us），在50MHz時鐘下的延時范....
      的頭像 ZYNQ 發(fā)表于 11-05 11:26 ?107次閱讀

      Verilog表達式的位寬確定規(guī)則

      很多時候，Verilog中表達式的位寬都是被隱式確定的，即使你自己設(shè)計了位寬，它也是根據(jù)規(guī)則先確定位....
      的頭像 ZYNQ 發(fā)表于 10-22 15:41 ?135次閱讀
      Verilog表達式的位寬確定規(guī)則

      如何寫出好的代碼？高質(zhì)量代碼的三要素

      膾炙人口的詩"春有百花秋有月，夏有涼風(fēng)冬有雪"，意境唯美，簡明易懂。好的代碼也是讓人陶醉的，那么如何....
      的頭像 ZYNQ 發(fā)表于 01-05 11:29 ?1159次閱讀
      如何寫出好的代碼？高質(zhì)量代碼的三要素

      SERDES的作用 SerDes基礎(chǔ)知識詳解

      SERDES是英文SERializer(串行器)/DESerializer(解串器)的簡稱。
      的頭像 ZYNQ 發(fā)表于 01-04 09:04 ?3902次閱讀
      SERDES的作用 SerDes基礎(chǔ)知識詳解

      FPGA學(xué)習(xí)入門從點燈開始

      首先，F(xiàn)PGA開發(fā)工程師是一個相對高薪的工作，但是，很多同學(xué)在剛?cè)腴T時都會有一種無從下手的感覺，尤其....
      的頭像 ZYNQ 發(fā)表于 12-28 09:50 ?469次閱讀

      Verilog實現(xiàn)DDS正弦波發(fā)生器

      DDS 同 DSP（數(shù)字信號處理）一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS 是直接數(shù)字式頻率合成器（Di....
      的頭像 ZYNQ 發(fā)表于 12-22 09:48 ?1027次閱讀
      Verilog實現(xiàn)DDS正弦波發(fā)生器

      APB協(xié)議UVM驗證環(huán)境的搭建流程

      只需編譯這兩個文件即可
      的頭像 ZYNQ 發(fā)表于 12-04 09:10 ?1610次閱讀
      APB協(xié)議UVM驗證環(huán)境的搭建流程

      如何設(shè)計一個參數(shù)化的數(shù)據(jù)選擇器

      在FPGA設(shè)計中，大部分情況下我們都得使用到數(shù)據(jù)選擇器。并且為了設(shè)計參數(shù)化，可調(diào)，通常情況下我們需要....
      的頭像 ZYNQ 發(fā)表于 11-20 10:27 ?1070次閱讀
      如何設(shè)計一個參數(shù)化的數(shù)據(jù)選擇器

      什么是PCIe？PCIe有什么用途？PCIe 5.0有何不同？

      隨著英特爾Alder Lake CPU的發(fā)布，以及AMD 7000 Ryzen CPU的即將發(fā)布，P....
      的頭像 ZYNQ 發(fā)表于 11-18 16:48 ?3269次閱讀
      什么是PCIe？PCIe有什么用途？PCIe 5.0有何不同？

      FPGA學(xué)習(xí)筆記：邏輯單元的基本結(jié)構(gòu)

      邏輯單元在FPGA器件內(nèi)部，用于完成用戶邏輯的最小單元。
      的頭像 ZYNQ 發(fā)表于 10-31 11:12 ?1662次閱讀
      FPGA學(xué)習(xí)筆記：邏輯單元的基本結(jié)構(gòu)

      用VHDL語言創(chuàng)建一個8位算術(shù)邏輯單元(ALU)

      在這個項目中，我們用 VHDL 語言創(chuàng)建一個 8 位算術(shù)邏輯單元 (ALU)，并在連接到帶有輸入開關(guān)....
      的頭像 ZYNQ 發(fā)表于 10-24 17:05 ?1857次閱讀
      用VHDL語言創(chuàng)建一個8位算術(shù)邏輯單元(ALU)

      小米發(fā)布全新操作系統(tǒng)，到底是啥？

      上周，有數(shù)碼博主爆料稱 MIUI 14 是 MIUI 最后一個正式的大版本，是 “封箱之作”........
      的頭像 ZYNQ 發(fā)表于 10-18 15:44 ?1057次閱讀
      小米發(fā)布全新操作系統(tǒng)，到底是啥？

      FPGA開發(fā)語言的選擇

      一般的 VHDL 程序可以由實體（Entity）、結(jié)構(gòu)體（Architecture）、配置（Conf....
      的頭像 ZYNQ 發(fā)表于 10-17 16:13 ?870次閱讀
      FPGA開發(fā)語言的選擇

      5G歸來的華為，華為Mate60 Pro突然開售！

      至于為什么這么突然發(fā)布旗艦新機，華為終端官博官宣時表示，主要是慶祝華為 Mate 系列手機今天累計發(fā)....
      的頭像 ZYNQ 發(fā)表于 08-30 15:36 ?1767次閱讀
      5G歸來的華為，華為Mate60 Pro突然開售！

      英偉達是如何成為AI芯片霸主的？

      該公司是 ChatGPT 和其他生成人工智能(AI) 應(yīng)用程序興起的最大受益者，幾乎所有這些應(yīng)用程序....
      的頭像 ZYNQ 發(fā)表于 08-25 15:40 ?1081次閱讀
      英偉達是如何成為AI芯片霸主的？

      到底誰能提升Calibre的效率？

      Siemens的Calibre是業(yè)內(nèi)權(quán)威的版圖驗證軟件，被各大Foundry廠廣泛認可。用戶可以直接....
      的頭像 ZYNQ 發(fā)表于 07-25 10:30 ?1026次閱讀
      到底誰能提升Calibre的效率？

      什么是RDMA？什么是RoCE網(wǎng)絡(luò)技術(shù)？

      在數(shù)據(jù)為王的時代，人們對網(wǎng)絡(luò)的要求更加嚴苛。然而傳統(tǒng)的TCP / IP以太網(wǎng)連接占用了大量的CPU資....
      的頭像 ZYNQ 發(fā)表于 07-24 17:40 ?6731次閱讀
      什么是RDMA？什么是RoCE網(wǎng)絡(luò)技術(shù)？

      放棄千億投資，富士康為何退出印度？

      路透社援引知情人士透露，上述合資工廠的計劃進展緩慢。出于對印度政府延遲批準(zhǔn)激勵措施的擔(dān)憂，這是富士康....
      的頭像 ZYNQ 發(fā)表于 07-14 15:43 ?1274次閱讀

      如何取替英偉達？如何顛覆英偉達？

      隨著生成式AI的火熱以及英偉達市值沖破萬億美元，如何取替英偉達，成為AI芯片市場新貴，又成為了一個熱....
      的頭像 ZYNQ 發(fā)表于 07-10 11:21 ?1451次閱讀
      如何取替英偉達？如何顛覆英偉達？

      ASML將向中國推出“特供版”DUV***？？

      光刻機是半導(dǎo)體產(chǎn)業(yè)的重要設(shè)備之一。網(wǎng)傳荷蘭ASML（阿斯麥）試圖規(guī)避荷蘭新銷售許可禁令，向中國推出特....
      的頭像 ZYNQ 發(fā)表于 07-07 11:50 ?1562次閱讀
      ASML將向中國推出“特供版”DUV***？？

      從30天到17小時，如何讓HSPICE仿真效率提升42倍？

      C社相關(guān)負責(zé)人表示：算力不足是目前IC設(shè)計行業(yè)普遍面臨的問題。對于EDA上云，公司之前沒有嘗試過，對....
      的頭像 ZYNQ 發(fā)表于 07-05 10:18 ?1166次閱讀
      從30天到17小時，如何讓HSPICE仿真效率提升42倍？

      誰是全球市值最高的芯片公司？

      在過去幾十年里，英偉達有著自己的戰(zhàn)略定位，這可能是能夠取得如此成功的推動力。尤其是英偉達的“超級計算....
      的頭像 ZYNQ 發(fā)表于 07-04 09:31 ?647次閱讀

      中國芯片最新50強榜單發(fā)布！

      自動駕駛：安全標(biāo)準(zhǔn)也將是完全自動駕駛汽車能否實現(xiàn)發(fā)展和商業(yè)化的關(guān)鍵因素，并且這無疑是無人駕駛汽車大規(guī)....
      的頭像 ZYNQ 發(fā)表于 06-26 11:28 ?7272次閱讀
      中國芯片最新50強榜單發(fā)布！

      如何看待華為1100億行規(guī)模的代碼庫

      首先，我們需要了解代碼庫規(guī)模的背后。在華為這樣的大型科技公司中，代碼庫規(guī)模的增長是必然的。隨著公司業(yè)....
      的頭像 ZYNQ 發(fā)表于 05-16 09:45 ?685次閱讀

      ASML真的壓貨太多了嗎？

      最近聽到一則消息說是ASML說是壓貨太多，但是其實我們買都買不到。
      的頭像 ZYNQ 發(fā)表于 04-21 09:05 ?1181次閱讀

      Xilinx FPGA MIPI接口簡單說明

      講一講Xilinx家的MIPI方案。 這里以普通7系列作為討論的對象， X家高端的KU+/MPSOC....
      的頭像 ZYNQ 發(fā)表于 04-19 14:04 ?4358次閱讀
      Xilinx FPGA MIPI接口簡單說明

      什么是IPSec？IPSEC協(xié)議簇安全框架介紹

      IPSec（Internet Protocol Security）：是一組基于網(wǎng)絡(luò)層的，應(yīng)用密碼學(xué)的....
      的頭像 ZYNQ 發(fā)表于 04-12 10:05 ?3186次閱讀

      LVDS高速ADC接口， xilinx FPGA實現(xiàn)

      使用的AD芯片是ADI的AD9653，125M16bit高精度高速ADC，用到的采樣速率是80M。其....
      的頭像 ZYNQ 發(fā)表于 04-03 10:28 ?5331次閱讀

      在FPGA上實現(xiàn)一個模塊，求32個輸入中的最大值和次大值

      從算法本身來看，找最大值和次大值的過程很簡單；通過兩次遍歷：第一次求最大值，第二次求次大值; 算法復(fù)....
      的頭像 ZYNQ 發(fā)表于 03-31 11:18 ?995次閱讀