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FPGA開發(fā)

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通用FPGA開發(fā)

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定點(diǎn)乘法器設(shè)計(jì)優(yōu)化V1

因?yàn)榉抡娴腁比較小,15位的值和符號(hào)位是一樣的,沒有影響,所以當(dāng)時(shí)沒有發(fā)現(xiàn)。需要對(duì)符號(hào)位擴(kuò)展一位,變....
的頭像 FPGA開發(fā) 發(fā)表于 04-14 09:34 ?603次閱讀
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