嗨，有沒有人知道可以在Spartan6中實現(xiàn)的SD SDI音頻嵌入解決方案的參考設計或IP核（免費或付費）？我見過XAPP1014提供了非常好的參考設計，但對于SD數(shù)據(jù)速率，它只有一個音頻去嵌入器而
2019-07-29 08:22:28
親愛的論壇，我正在處理將** II SRAM連接到Spartan-6 FPGA的問題。我不是斯巴達IP核的專家，但我意識到Spartan-6沒有預見到的QDR接口。但是我確信它可以做到。我遇到的唯一
2019-05-22 07:16:30
我正在編寫自己的代碼用于我的Spartan6 FPGA的JTAG配置。但是，我無法讓它發(fā)揮作用。出于調(diào)試目的，我想嘗試讀取配置寄存器（例如STAT，IDCODE），但也不能這樣做。這是我粗略
2019-05-24 13:14:10
我正在為使用Spartan-6 LX45T的XMC卡開發(fā)硬件。我對VHDL的總體經(jīng)驗很少，所以我所做的就是在將硬件交給外部開發(fā)人員之前對PCIe鏈接進行限定。我使用ISE 14.7生成PCIe核心
2020-04-15 07:32:57
大家好，我設計了一個紅外線凸輪。我使用Spartan6 fpga來控制相機操作。完成設計后，當用戶打開相機電源時，閃存中的數(shù)據(jù)必須啟動fpga。對于啟動操作，我是使用微控制器還是cpld進行啟動操作
2019-05-31 12:05:10
？ Spartan6是否包含基板高性能電容器，如Virtex5和6？具有推薦的旁路上限值的其他人的經(jīng)驗是什么？謝謝！以上來自于谷歌翻譯以下為原文We're laying outa Spartan 6
2019-05-29 07:36:22
我正在測試spartan6上的serdes，我無法通過32位寬的數(shù)據(jù)傳遞結果。我的電路使用8位和16位寬數(shù)據(jù)。在一個范圍內(nèi)，我可以看到看起來移位或不一致的東西以32位寬的IO數(shù)據(jù)輸出接收器輸出
2019-07-24 08:17:30
嗨，我正在使用spartan6 LX100 676。目前我的利用率是8％，所有引腳分配，2 pll使用，2 mcb（DDR2-240Mhz DDR）。大多數(shù)數(shù)字引腳工作在80Mhz頻率。運行
2019-05-30 09:48:02
嗨，我是學生我研究了如何在SPARTAN6中設計部分重新配置好幾個月，但仍然不知道如何使用它。有我的知識： - 通過planAhead實施設計PlanAhead的部分重新配置設計。 （我
2019-02-22 08:22:33
大家好，對于通用I / O（不是GTxx收發(fā)器或內(nèi)存控制器），在Spartan6上使用內(nèi)部終端是否需要特殊連接或外部組件？ （即GND或Vcco的電阻）？到目前為止我發(fā)現(xiàn)的只有： - 方便
2019-06-04 15:21:12
我嘗試使用“clockin向?qū)А?b class="flag-6" style="color: red">在Spartan6中使用PLL我們可以指定的2個參數(shù)是輸入和輸出抖動。但是與構建PLL的常用參數(shù)有什么關系：1）輸入捕獲范圍，定義輸入頻率的窗口：是輸入抖動嗎？2
2019-06-06 11:14:34
大家好，在實現(xiàn)目標設備（Spartan 6-LX45）上的軟件（使用ISE 14.6的VHDL）之前，我在評估板（Spartan 6-LX9）上測試了我的FPGA-Design。在此轉(zhuǎn)換過程中發(fā)生一
2019-07-15 08:28:26
你好，我在用AD9834和AD8014生成正弦波時使用的是ADI公司提供的CN--0304電路，但這為什么它的頻率僅僅到18Mhz（AD9834和AD8014自身的頻率都遠遠比這個高），我希望
2019-02-14 14:38:39
AD10生成gerber文件的詳細說明：
2015-05-12 16:03:21
Altium Designer6生成gerber File1）點擊“開始”—>“Altium Designer6” 打開軟件
2019-07-09 07:29:19
DSP28335生成SPWM方法1、不對稱規(guī)則采樣
2013-01-17 14:02:08
原子哥，IAR 4.11生成的TXT文件沒有數(shù)據(jù)，我是SF_BSL 430下載軟件， 是我的下載軟件有問題還是？
2019-03-07 23:24:02
請教Labview調(diào)用VB6生成的DLL,我現(xiàn)試了好多不行，在此還高手支招，不勝感激！QQ:***,***：18934586535 急急急
2013-12-18 21:48:17
STM32生成基本工程。包括定時器、SPI、CAN、GPIO、NVIC基本配置，完成后可以閃燈運行
2019-03-11 18:46:09
STM32F746ZGT6生成的hex文件是否兼容STM32F756ZGT6？求解
2022-12-12 06:29:56
芯片是stm32f103，用mdk4生成bin可以使用；用mdk5生成bin，可以生成。但是下進去沒有反應。有大神知道怎么解決嗎？
2016-04-17 21:35:51
Spartan6 SRIO，clk pad是浮動的，有沒有辦法使用SRIO
2019-08-01 08:59:05
大家好，我正在使用Spartan 6 FPGA，我嘗試生成LVDS差分時鐘來為ADC提供時鐘。我使用SP601評估板，并在FMC連接器的一對引腳上發(fā)送差分信號。這個時鐘工作頻率高達650Mhz，但我
2019-08-09 09:34:19
嗨，我是這個論壇的新人。我有一點關于fifo_generator_v9_2的問題，當我嘗試為spartan6生成一個fifo ip_core時，控制臺上會出現(xiàn)以下警告：警告：sim - 組件
2019-11-11 16:28:27
的設置適用于spartan6？2.我發(fā)現(xiàn)XAPP894.zip中提供的sim_model.pdf使用100歐姆串聯(lián)電阻而不是150歐姆電阻，哪一個是正確的？3.我指定的io標準是否正確。 現(xiàn)在電路板存在MIPI傳輸問題，MIPI接收主機無法接收任何數(shù)據(jù)。我在找原因?，F(xiàn)在我懷疑硬件連接的正確性。新
2019-08-07 09:12:51
啟動映像） ，然后通過禁用BitG??en選項中的多引導功能生成多引導位。順便說一下，我使用的閃存是8M位SPI閃存（來自atmel）。IPROG cmds是spartan6配置數(shù)據(jù)表的100％，G3
2019-07-19 09:12:14
我正在使用spartan6 gtp收發(fā)器向?qū)?。但沒有外部時鐘。相反，我使用時鐘向?qū)褂?00 M振蕩器生成所需的速率。我嘗試使用chipcope測試示例設計，但錯誤計數(shù)信號正在增加gradullay。誰能幫幫我嗎？
2019-08-06 10:47:32
嗨，我在使用SPI閃存芯片配置我的spartan 6設計時遇到問題。我看過其他論壇條目（似乎有很多）但仍然沒有解決它。我已經(jīng)包含了一個原理圖（這是一個相當大的工作表，但我把它減少到配置的東西）。這是
2019-07-16 13:05:05
全新Xilinx Spartan6 Nexys3 開發(fā)板轉(zhuǎn)讓！從未使用！950包郵~需要的聯(lián)系我。
2014-01-01 17:20:18
我想知道Spartan6中外部振蕩器的要求。有關頻率穩(wěn)定性的要求等等。我已經(jīng)檢查了Spartan6的數(shù)據(jù)表，但我沒有找到詳細和具體的標準以上來自于谷歌翻譯以下為原文I want to know
2019-05-10 14:31:23
給大家分享一下關于Spartan6板子的使用心得。
2021-04-30 07:03:13
求大神分享一些關于spartan6套件試用心得
2021-04-15 06:42:05
spartan6是不支持一個BANK連接兩個DDR2的，這是因為DDR2是硬核，延遲都是固定的，為了幫助那些不小心把SP6當成V5系列的誤把一個BANK連接2個或者多個DDR2的朋友們，同時在12.9月份
2015-03-16 20:21:26
如何使用spartan6芯片驅(qū)動TFT顯示屏？如何使用xlinx軟件編程？
2016-12-21 16:23:22
嗨，大家好 我知道如何使用RTL代碼回讀SPARTAN6器件的器件，通過實例化DNA_PORT很容易實現(xiàn)。 但是在SPARTAN3E中，沒有這種原始來源。 劑量SPARTAN3E無法回讀設備ID
2019-07-10 08:40:32
帶有Spartan6的新電路板將使用SPI閃存Spansion S25FL19P（扇區(qū)為64kB）。此SPI閃存列為與Impact兼容。唉沒有描述連接模式。它可以在簡單的1數(shù)據(jù)線輸出中工作嗎？它會
2019-07-24 13:48:52
如何利用RK3288生成新的簽名文件？
2022-03-03 07:56:00
Virtex 6中，我發(fā)現(xiàn)TXRATE和RXRATE端口，為這些端口驅(qū)動適當?shù)闹?，能?b class="flag-6" style="color: red">生成GEN1和GEN2時鐘。斯巴達6中有這樣的港口嗎？如果不是，我們?nèi)绾卧?b class="flag-6" style="color: red">SPARTAN 6 phy的GEN1和GEN2
2019-07-24 09:31:51
我將在spartan6 LX150T Bank2中設計lvds接口，將有15對lvds信號。和其他信號（約90個信號）將被用于單個信號?？赡軉?？我如何設置bank2？如果你知道這個方法，請告訴我
2019-07-25 13:41:58
親愛的大家！ 如何在IOB中為spartan-3生成FPGA使用TFF（TFF1和TFF2三態(tài)觸發(fā)器）？ 我想在spartan-3 FPGA（Spartan-3 GenerationFPGA用戶指南
2019-06-28 09:53:28
親愛的專家 我嘗試通過GTP（S6）/ GTX（V6）在SP605（Spartan6）和ML605（Virtex6）之間建立通信， 我想連接兩個主板的SFPlight模塊，并且定義極光協(xié)議，但我
2019-07-31 10:37:43
如何用DAC0832生成多種波形？
2022-01-24 06:01:04
誰能告訴我如何給FPGA SPARTAN6套件提供128位輸入？我們?nèi)绾闻渲盟ㄟ^16個開關接受128位輸入？以上來自于谷歌翻譯以下為原文can anyone tell me how to give
2019-07-22 08:33:05
嗨，我正在嘗試使用Spartan 3E500生成一個4相數(shù)字時鐘（每個占空比為25％）。 DCM提供完美的相移，但無法調(diào)整占空比。無論如何我可以獲得如下的時鐘信號？（只要時鐘與時鐘之間沒有重疊，就會很好）。謝謝！
2019-09-11 07:16:01
大家好！我正在使用Spartan6 FPGA為高速DAC提供數(shù)據(jù)。必要的高速I / O時鐘由PLL實例完成。在我的申請中，我有兩種不同的情況：case1：我需要從80MHz參考（M = 12）產(chǎn)生
2019-07-31 10:59:14
在安裝labview2017后，發(fā)現(xiàn)用labview8.6生成的發(fā)布無法再xp系統(tǒng)上使用了，提示必須要windows7或者更高的版本，有沒有辦法讓labview8.6生成的發(fā)布在xp系統(tǒng)上也可以使用？
2018-01-25 15:50:40
你好我目前正在為Spartan 6 XC6SLX150生成位文件。有人提到Xilinx和Vivado的評估版不支持這個特定的部件號。因此，我們碰巧獲得了Vivado的浮動許可證。有人提到，一旦
2020-04-08 08:12:40
我需要為防御等級Spartan 6生成一個IBIS文件，用于PCB信號完整性。我已經(jīng)安裝了最新版本的ISE。我正在使用30天的eval許可證，直到我獲得IT安裝的浮動許可證。我試圖生成IBIS模型
2019-07-10 15:01:24
我正在使用spartan6 MCB與DDR2建立接口。我是VHDL的新手。在我預先編寫的示例設計數(shù)據(jù)和地址中，我想修改設計以給出用戶定義的數(shù)據(jù)和地址，并且想要添加三個控制信號wr，rd
2020-03-25 07:31:23
大家好， 有沒有人知道將標準限幅正弦波振蕩器連接到Spartan6的簡單，漂亮和干凈的方法？謝謝你的幫助巴勃羅以上來自于谷歌翻譯以下為原文Hi Everybody, Does anyone know
2019-05-16 12:00:46
嗨，我正在嘗試使用spartan6塊rams作為真正的雙端口ram，數(shù)據(jù)寬度為20bits。所以實例化的宏由xilinx.i提供.Spartan-6庫指南用于HDL設計，但我無法獲取是否啟用和重置
2019-07-26 13:22:01
在我進行數(shù)據(jù)包修改后，我嘗試更新Spartan6 CRC校驗和失敗。這不是Virtex / E / 2 / 2P / 4/5/6/7或Spartan3E的問題，但Spartan6完全不同。我知道
2019-07-08 07:39:34
doing a design using Spartan6 LX150 FGG676 FPGA, can I ask for some reference schematic which uses the external memory? Thanks,Anna
2019-07-02 08:54:43
嗨！我正在使用Spartan6 XC6SLX9，我想編寫Flash PROM，這樣做： - 我制作了一個MCS文件：+配置單個FPGA+存儲設備：32M+ SPI PROM：M25P32 - 當我
2020-04-26 13:45:52
; Xilinx Reference Design（見附件），該參考程序用的是KC705開發(fā)板，芯片是Kintex-7，而我買的是SDP-H1開發(fā)板，用的是Spartan6芯片。在microblaze中
2018-10-25 09:18:48
一、問題最近做了下門禁系統(tǒng)用到舵機，但是用TIM1生成PWM驅(qū)動舵機時，發(fā)現(xiàn)給出命令后，要等一會兒舵機才能響應轉(zhuǎn)動。于是四處找問題，終于在網(wǎng)上找到一些大神的結論，在這里做下記錄，也希望幫到遇到同樣問題的人。...
2021-08-16 08:44:29
懷疑它是由ARM調(diào)試器運行引起的JTAG引腳上的活動，這是問題的根源。我想知道：Spartan6如何決定它應該通過JTAG接受配置數(shù)據(jù)而不是通過SelectMap？ SelectMap配置是否會失敗，因為JTAG活動，即使ARM調(diào)試器沒有“尋址”FPGA？任何建議都感激不盡！
2020-06-01 07:40:34
缺少由Cosmic C 4.2.8生成的代碼以上來自于谷歌翻譯以下為原文 Missing Code generated from Cosmic C 4.2.8
2019-04-08 14:13:50
我有一個Spartan6 LX 150T開發(fā)板。我還有一個FMC XM 105 Rev B調(diào)試卡，它連接到開發(fā)板的JX1端口。但是，我不知道FPGA上的哪些引腳映射到電路板上JX1 / JX2連接器
2019-06-20 09:30:52
大家好，我開發(fā)了DDR2內(nèi)存和高速ADC 500Mpbs（2 ADC）到Spartan6 LX25器件。我想知道銀行分配的最佳選擇，因為接口都是高速且需要時鐘定時至關重要。根據(jù)MIG的推薦，DDR2
2019-07-12 06:30:06
我試圖將工作代碼從Spartan3設計移植到Spartan6設計，我遇到了一個我無法解決的問題。當我最初在實際硬件上合成并實現(xiàn)設計時，似乎存在一個時序問題，這會阻止我的設計與主機系統(tǒng)通信。我決定
2019-11-04 09:43:55
CLOCK_DEDICATED_ROUTE約束已應用于COMP.PIN，允許您的設計繼續(xù)。此約束禁用與指定的COMP.PIN相關的所有時鐘布局器規(guī)則。我想知道可以在spartan6中實現(xiàn)這樣的電路嗎？或者，有沒有
2019-07-29 15:03:38
你好在spartan6中，發(fā)生配置錯誤時I / O是什么？KS
2019-08-02 09:54:34
有人知道Spartan6 LXT設備中DVB-ASI TS接口的工作解決方案或應用說明嗎？以上來自于谷歌翻譯以下為原文Does anybody know a working solution
2019-05-20 13:53:57
等，它的作用是各種高速串行接口的物理層。對Spartan6系列而言，GTPA1_DUAL包含兩個GTP transceiver，或者說包含兩個通道。
2018-07-14 06:45:00
17860 
Spartan6系列是一類低成本高容量的FPGA，采用45nm低功耗敷銅技術，能在功耗、性能、成本之間很好地平衡；Spartan6系列內(nèi)部采用雙寄存器、6輸入的LUT，還有一系列的內(nèi)建系統(tǒng)級模塊
2018-07-14 06:45:0030731 《Spartan6開發(fā)中bufpll mapping error 》 最近在做Spartan6上的視頻輸出，輸出的接口是HDMI接口，要求格式是720P。
2017-02-11 11:56:042019 使用XILINX公司的Spartan6芯片，也是最近半年的事情。該芯片由于上市時間不長，在使用該芯片的時候各位網(wǎng)友分享的心得也比較少；再加上第一次開發(fā)使用它，開發(fā)過程肯定會遇到很多很多棘手頭疼的問題。
2017-02-11 11:56:357003 
Spartan6系列FPGA常見的配置模式有5種，該5種模式可分為3大類，1. JTAG模式（可歸為從模式）；2. 主模式；3. 從模式。主模式又劃分為master serial模式、master parallel模式，從模式分為slave serial模式、slave parallel模式兩種。
2018-03-21 11:43:004853 黑金Spartan6開發(fā)板的Verilog教程詳細說明
2023-10-11 18:02:45
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