各控制信號的具體時序說明 - 基于快速傅里葉IP核的數(shù)字脈壓處理器的實現(xiàn)

　　在采樣距離門有效期間，將樣本數(shù)據(jù)寫入FIFO中進行緩存。采樣結(jié)束后，通過FFT單元的寫使能信號（NFFT_WE和FWD_INV_WE）將NFFT=01010及FWD_INV_WE=1寫入狀態(tài)控制寄存器設(shè)定工作模式，接著啟動START信號進行FFT運算，寫使能信號與sTART之間僅差1個時鐘周期。運算結(jié)束后，DONE信號有效1個時鐘周期，輸出使能信號UNLOAD與DONE同步，經(jīng)過7個時鐘周期后數(shù)據(jù)有效信號DV開始有效，F(xiàn)FT運算結(jié)果開始流水輸出，同時與匹配濾波器的系數(shù)相乘，并存入RAM中。由于乘法運算的固有延遲，寫使能RAM_EN延遲DV信號2個時鐘周期。存儲結(jié)束時，IFFT單元的寫使能信號同時有效，并設(shè)定NFFT=01010及FWD_INV_WE=0，接著啟動START信號進行IFFT運算。運算結(jié)束后，DONE信號（與UNLOAD同步）再次有效，IFFT運算輸出結(jié)果在DV信號有效期間直接寫入RAM中。單個PRT內(nèi)各控制信號的具體時序說明如圖4所示。

　　

　　2.2.3 塊浮點數(shù)據(jù)格式

　　在數(shù)字信號處理系統(tǒng)中，數(shù)據(jù)表示格式可分為定點制、浮點制和塊浮點制，它們在實現(xiàn)時對系統(tǒng)資源的要求不同，工作速度也不同，有著不同的適用范圍。定點表示法使用最多，簡單且速度快，但動態(tài)范圍有限，需要用合適的溢出控制規(guī)則（如定比例法）適當壓縮輸入信號的動態(tài)范圍，但這樣會降低輸出信號的信噪比。浮點表示法的優(yōu)點是動態(tài)范圍大，可避免溢出，能在很大的動態(tài)范圍內(nèi)達到很高的信噪比，主要缺點是系統(tǒng)實現(xiàn)復(fù)雜，硬件需求量大，成本和功耗高，而且速度較慢。

　　塊浮點表示法兼有定點法和浮點法的某些優(yōu)點，是以上2種表示法的結(jié)合。這種表示法首先對一組數(shù)據(jù)進行檢測，歸一化最大數(shù)的小數(shù)部分，再建立適當?shù)闹笖?shù)。接著把剩下數(shù)據(jù)的小數(shù)部分轉(zhuǎn)化為合適的數(shù)，使它們可以使用最大數(shù)的指數(shù)。塊浮點算法的主要優(yōu)點是：大動態(tài)范圍、低截斷（或舍入）噪聲，是一種有效的數(shù)據(jù)表示形式。從芯片實現(xiàn)角度上看，塊浮點表示法能夠保證較高的信號處理質(zhì)量，尤其適用于FFT運算的場合。脈壓模塊中的FFT核帶有塊浮點運算的功能，整個運算過程中的數(shù)據(jù)格式表示如圖5所示。

　　

　　ADC輸入數(shù)據(jù)為14b的二進制補碼形式，對其低位補零擴展為16b（IP核要求的輸入精度）后送入FFT運算單元，輸出結(jié)果為16b的定點數(shù)以及指數(shù)EXP1。復(fù)乘包括乘法和累加運算，即FFT結(jié)果與匹配系數(shù)進行16b×16b的乘法運算，所得結(jié)果再進行加法運算；在進行加法運算前，所有數(shù)據(jù)擴展為33b以防止溢出的發(fā)生，最終數(shù)據(jù)截取高16b送入IFFT處理單元，輸出為16b的定點數(shù)和指數(shù)EXP2，將其與EXPl相加后得到指數(shù)EXP。脈壓的最終結(jié)果即為IFFT后的16b定點數(shù)以及指數(shù)EXP，兩者分別存儲在FPGA片內(nèi)RAM中。