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      電子發(fā)燒友網(wǎng)>電子資料下載>通信網(wǎng)絡>基于RocketIO的高速串行協(xié)議設計與實現(xiàn)

      基于RocketIO的高速串行協(xié)議設計與實現(xiàn)

      2010-09-22 | rar | 433 | 次下載 | 5積分

      資料介紹

      采用Xilinx 公司Virtex- II Pro 系列FPGA 內(nèi)嵌得SERDES 模塊———RocketIO 作為高速串行協(xié)議的物理層, 利用其8B/10B的編解碼和串化、解串功能, 實現(xiàn)了兩板間基于數(shù)據(jù)幀的簡單高速串行傳輸, 并在ISE 環(huán)境中對整個協(xié)議進行了仿真, 當系統(tǒng)頻率為100MHz, 串行速率在2Gbps 時, 在驗證板上用chipscope 抓取的數(shù)據(jù)表明能夠?qū)崿F(xiàn)兩板間數(shù)據(jù)的高速無誤串行傳輸。
      關鍵詞: RocketIO;高速串行傳輸;SERDES;協(xié)議

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