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      電子發(fā)燒友網>電子資料下載>傳感與控制>基于AXI總線的RapidIO端口控制器IP核的設計方法

      基于AXI總線的RapidIO端口控制器IP核的設計方法

      2017-11-01 | rar | 0.84 MB | 次下載 | 免費

      資料介紹

      　　現(xiàn)代數(shù)字信號處理技術的發(fā)展，要求系統(tǒng)高速并實時傳輸大量數(shù)據(jù)，這對傳輸數(shù)據(jù)總線提出了更高的要求。Rapidl0這種高速串行總線具有帶寬高、延時低的特點，為嵌入式系統(tǒng)內部互聯(lián)通信提供了良好的解決方案。另一方面，高速串行總線的應用又對數(shù)據(jù)存儲提出了更高的要求，如何更高效實時的進行數(shù)據(jù)存儲成為了新的研究方向。固態(tài)存儲這種完全采用半導體芯片作為數(shù)據(jù)存儲介質和讀取機構的存儲形式，摒棄了磁盤物理和機械特性的缺陷?；诖?，本設計采用Rapidl0總線結構和mSATA固態(tài)硬盤，提出了一種基于VPX標準的存儲模塊設計方案。

      基于AXI總線的RapidIO端口控制器IP核的設計方法

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