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      高速信號、時鐘及數(shù)據(jù)捕捉：數(shù)據(jù)轉(zhuǎn)換

      2009-09-25 | rar | 551 | 次下載 | 免費(fèi)

      資料介紹

      高速信號、時鐘及數(shù)據(jù)捕捉：數(shù)據(jù)轉(zhuǎn)換
      系統(tǒng)背后的運(yùn)作原理
      — 作者：Ian King 美國國家半導(dǎo)體公司應(yīng)用技術(shù)工程師
      隨著仿真/數(shù)字轉(zhuǎn)換器的數(shù)據(jù)轉(zhuǎn)換取樣率提高至每秒千兆個取樣 (GSPS) 以上的水平，
      數(shù)據(jù)轉(zhuǎn)換系統(tǒng)必須作出相應(yīng)的配合，才可支持這樣高的轉(zhuǎn)換率，而其它支持性的模
      擬組件也必須產(chǎn)生系統(tǒng)所需的高頻信號，然后將之放大。系統(tǒng)設(shè)計(jì)工程師除了要對
      仿真信號路徑有深入的了解之外，也要徹底認(rèn)識取樣時鐘以及系統(tǒng)如何以高位速率
      捕捉數(shù)字信號。本文將會就有關(guān)上述兩個重要的問題提供多個不同的解決方案。以
      下所討論的數(shù)據(jù)有助我們深入了解采用高性能模/數(shù)轉(zhuǎn)換器的系統(tǒng)。
      時鐘電路
      時鐘電路是高速數(shù)據(jù)轉(zhuǎn)換系統(tǒng)最重要的子電路之一，因?yàn)闀r鐘信號能否準(zhǔn)確定時會
      直接影響模/數(shù)轉(zhuǎn)換器的動態(tài)性能。為了減低其影響，模/數(shù)轉(zhuǎn)換器時鐘電路的定時
      抖動或相位噪聲必須極低。若選擇時鐘電路時沒有將這個因素加以考慮，那么即使
      所采用的前端仿真輸入電路或模/數(shù)轉(zhuǎn)換器性能非常卓越，系統(tǒng)性能也可能會不如
      想象中理想。完美的時鐘永遠(yuǎn)可以在精確的時間內(nèi)提供跳變沿。但實(shí)際上，時鐘沿
      會不斷出現(xiàn)在不同時間內(nèi)，正因?yàn)闀r間的不確定性，取樣后波形的信噪比受到數(shù)據(jù)
      轉(zhuǎn)換過程的影響。
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