資料介紹
隨著微電子技術(shù)的高速發(fā)展,新器件的應(yīng)用導(dǎo)致現(xiàn)代 EDA 設(shè)計的電路布局密度大,而且信號的頻率也很高,隨著高速器件的使用,高速 DSP(數(shù)字信號處理)系統(tǒng)設(shè)計會越來越多,處理高速 DSP 應(yīng)用系統(tǒng)中的信號問題成為設(shè)計的重要問題,在這種設(shè)計中,其特點是系統(tǒng)數(shù)據(jù)速率、時鐘速率和電路密集度都在不斷增加,其 PCB 印制板的設(shè)計表現(xiàn)出與低速設(shè)計截然不同的行為特點,即出現(xiàn)信號完整性問題、干擾加重問題、電磁兼容性問題等等。
這些問題能導(dǎo)致或者直接帶來信號失真,定時錯誤,不正確數(shù)據(jù)、地址和控制線以及系統(tǒng)錯誤甚至系統(tǒng)崩潰,解決不好會嚴(yán)重影響系統(tǒng)性能,并帶來不可估量的損失。解決這些問題的方法主要靠電路設(shè)計。因此 PCB 印制板的設(shè)計質(zhì)量相當(dāng)重要,它是把最優(yōu)的設(shè)計理念轉(zhuǎn)變?yōu)楝F(xiàn)實的惟一途徑。下面討論針對在高速DSP 系統(tǒng)中 PCB 板可靠性設(shè)計應(yīng)注意的若干問題。
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