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DSP 最小系統(tǒng)的設計主要包括 1） 電源及復位電路設計 ，包括時鐘設計 ;2） J TA G仿真接口設計和存儲器設計。本文中采用的 MAX705 是一種智能監(jiān)控芯片 ，它可以輸出寬度高達 200 ms 的低電平復位脈沖 ，這足以保證 DSP 的可靠復位。 TMS320F240 控制器的時鐘模塊采用了鎖相環(huán)（PLL） 技術(shù)［3 ，4 ］
，可以對外部振蕩器的頻率進行倍頻。 本系統(tǒng)采用的是外部振蕩器 ，頻率為 10 M Hz ，通過對時鐘模塊的編程 ，將CPUCL K設定為 20 M Hz.在目標系統(tǒng)的設計中 ，采用了二片 61C1024 ，一片作為地址的高 8 位 ， 另一片為低 8 位。 SRAM61C1024 與 TMS320F240 的接口電路如圖 2所
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