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      電子發(fā)燒友網(wǎng)>電子資料下載>單片機(jī)>IIC總線電阻/電容的計(jì)算

      IIC總線電阻/電容的計(jì)算

      2022-01-14 | pdf | 未知 | 次下載 | 2積分

      資料介紹

      1.芯片IIC的接口配置一般為開漏，引腳需要外接上拉電阻才能保證正常通信。2.IIC電平的定義IIC規(guī)范將低于VIL或低于0.3VDD的電壓定義為邏輯低電平，同樣將高于VIH或高于0.7VDD的電壓定義為邏輯高電平。3.最小電阻的確定電源電壓限制了可允許總線拉低的最小上拉電阻值，過強(qiáng)的上拉會(huì)阻止器件充分拉低拉線的電平，導(dǎo)致無法確保邏輯低電平能被檢測(cè)到。在輸出級(jí)V_OLmax=0.4V 時(shí)指定I_OL為3mA，允許總線電壓拉低的最小上拉電阻公式：Rmin>=(VDD(min)-Vol)/3m
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