資料介紹
The SN74AHC125Q is a quadruple bus buffer gate featuring independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high. When (OE)\ is low, the respective gate passes the data from the A input to its Y output.
To ensure the high-impedance state during power up or power down, (OE)\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
- SN74AHC32Q-Q1,pdf(Quadruple 2-
- SN74AHC00-Q1,pdf(Quadruple 2-I
- SN74AHC245Q,pdf(Octal Bus Tran
- SN74LVC125A-Q1,pdf(Quadruple B
- SN74LV125AT,pdf(QUADRUPLE BUS
- SN74HC125-Q1,pdf(Quadruple Bus
- SN74AUC126,pdf(QUADRUPLE BUS B
- SN74AUC125,PDF(QUADRUPLE BUS B
- SN74ALVC125,PDF(QUADRUPLE BUS
- SN74AHCT125-Q1,pdf(Quadruple B
- SN74AHC244Q,pdf(Octal Buffer/D
- SN74AHC1G125,PDF(SINGLE BUS BU
- SN74AHC125-Q1,pdf(Quadruple Bu
- SN54AHC125, SN74AHC125,pdf(QUA
- SN74ABT125Q-Q1,pdf(Quadruple B
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