資料介紹
The CD54HC646 and CD74HCT646 consist of bus-transceiver circuits with 3-state outputs, D-type flip-flops, and control circuitry arranged for multiplexed transmission of data directly from the input bus or from the internal registers. Data on the A or B bus is clocked into the registers on the low-to-high transition of the appropriate clock (CLKAB or CLKBA) input. Figure 1 illustrates the four fundamental bus-management functions that can be performed with these devices.
Output-enable (OE\) and direction-control (DIR) inputs control the transceiver functions. In the transceiver mode, data present at the high-impedance port can be stored in either or both registers.
The select-control (SAB and SBA) inputs can multiplex stored and real-time (transparent mode) data.
- CD54HC280 CD74HC280 CD54HCT280 CD74HCT280數(shù)據(jù)表
- 帶復位的高速CMOS LogicHex D型觸發(fā)器CD54HC174 CD74HC174 CD54HCT174 CD74HCT174數(shù)據(jù)表
- 具有向下/向上模式控制的同步向上/向下計數(shù)器CD54HC190 CD74HC190 CD54HC191 CD74HC191 CD54HCT191 CD74HCT191數(shù)據(jù)表
- 高速CMOS邏輯預置計數(shù)器CD54/74HC161 CD54/74HCT161 CD54/74HC163 CD54/74HCT163數(shù)據(jù)表
- 高速CMOS LogicDual同步計數(shù)器CD74HC4518 CD54HC4520 CD74HC4520 CD74HCT4520數(shù)據(jù)表
- 高速CMOS邏輯八進制反相透明鎖存器CD54/74HC533 CD54/74HCT533 CD54/74HC563 CD74HCT563數(shù)據(jù)表
- 具有三態(tài)輸出的八進制總線收發(fā)器和寄存CD54HC646 CD74HCT646 數(shù)據(jù)表
- CD54HC4511,CD74HC4511,CD74HCT4
- CD54HC354,CD74HC354,CD74HCT354
- CD54HC00,CD74HC00,CD54HCT00,CD
- CD54HC08,CD74HC08,CD54HCT08,CD
- CD54HC245, CD74HC245, CD54HCT2
- CD54AC646,CD74AC646,CD54AC648,
- CD54HC04, CD74HC04, CD54HCT04,
- 74HC646 pdf datasheet
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