資料介紹
These 8-bit D-type transparent latches are designed specifically for storing the contents of the input data bus, plus reading back the stored data onto the input data bus. In addition, they provide a 3-state buffer-type output and are easily utilized in bus-structured applications.
While the latch enable (LE) is high, the Q outputs of the SN74ALS666 follow the data (D) inputs. The Q\ outputs of the SN74ALS667 provide the inverse of the data applied to its D inputs. The Q or Q\ output of both devices is in the high-impedance state if either output-enable (OE1\ or OE2\) input is at a high logic level.
Read back is provided through the read-back control (OERB\) input. When OERB\ is taken low, the data present at the output of the data latches passes back onto the input data bus.
- SN74ALS666、SN74ALS667鎖存器數(shù)據(jù)表
- SN54ALS996,SN74ALS996 8位鎖存器數(shù)據(jù)表
- 三個3輸入正與門SN54ALS11A SN54AS11 SN74ALS11A SN74AS11數(shù)據(jù)表
- 8輸入正NAND門SN54ALS30A SN54AS30 SN74ALS30A SN74AS30數(shù)據(jù)表
- SN54ALS137A,SN74ALS137A,SN74AS
- SN54ALS688,SN74ALS688,pdf(8-Bi
- SN54ALS520,SN74ALS518,SN74ALS5
- SN54ALS137A,SN74ALS173A,SN74AS
- SN54ALS569A,SN74ALS568A,SN74AL
- SN74ALS166,pdf(Parallel-Load 8
- SN74ALS165,pdf(Parallel-Load 8
- SN54ALS541, SN74ALS540, SN74AL
- SN54ALS541, SN74ALS540, SN74AL
- SN54AS1004A,SN74ALS1004,SN74AS
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