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VHDL 數(shù)位電子鐘
在這個(gè)數(shù)位電子鐘我們使用可支持VHDL 格式的MAX+plusII 軟件開發(fā)工具來(lái)做設(shè)計(jì)，利用VHDL 硬件描述語(yǔ)言的方式，將一個(gè)復(fù)雜的電路寫成一顆IC，有錯(cuò)誤也不用像以前那樣一次一次的慢慢修改，我們?cè)谲浖暇涂梢詫⑿薷碾娐?，而且MAX+plusII 中的仿真功能可為設(shè)計(jì)進(jìn)行除錯(cuò)與驗(yàn)證，能確保我們的設(shè)計(jì)與實(shí)作之間的正確性。
而且用VHDL 設(shè)計(jì)電路時(shí)可以不必熟記或翻閱各種電子組件邏輯及其規(guī)格的書籍，亦不必使電子電路局限在使用呆板的組件或零件組合成數(shù)位電子電路。使用VHDL 作數(shù)位電路設(shè)計(jì)，只需依據(jù)標(biāo)準(zhǔn)的VHDL 語(yǔ)言規(guī)范，描述復(fù)雜的電路系統(tǒng)，再用一般軟件的模塊化觀念，描述數(shù)位系統(tǒng)的規(guī)格及功能，接著利用軟件(可在PC或工作站上執(zhí)行)將所寫的VHDL 編譯合成電子電路，可以節(jié)省人工將傳統(tǒng)電子元件拼湊成電路的時(shí)間。
關(guān)鍵詞: MAX+plusII、VHDL、硬件描述語(yǔ)言
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