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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>一種基于 FPGA 的順序迭代FFT 設(shè)計(jì)

      一種基于 FPGA 的順序迭代FFT 設(shè)計(jì)

      2009-09-12 | rar | 170 | 次下載 | 5積分

      資料介紹

      ?????????本文從順序迭代的角度提出了一種高效的，容易實(shí)現(xiàn)的，占用資源少的FFT 算法結(jié)構(gòu)， 通過合理的設(shè)計(jì)使得系統(tǒng)占資源少而且高效，同時(shí)亦足夠簡(jiǎn)單。本文詳細(xì)描述了整個(gè)設(shè)計(jì)，在精簡(jiǎn)程度、完全的流水化、控
      制結(jié)構(gòu)方式、蝶形運(yùn)算、時(shí)序配合、存儲(chǔ)地址生成等方面均有一些特點(diǎn)。
      關(guān)鍵詞：現(xiàn)場(chǎng)可編程器件(FPGA) 快速傅立葉變換(FFT) 超高速硬件描述語言(VHDL)
      ?????????隨著微電子技術(shù)的飛速發(fā)展，傳統(tǒng)的可編程邏輯器件正在向大容量、高性能、低成本的方向發(fā)展，以CPLD/FPGA 為代表的可編程邏輯器件受到了世界范圍內(nèi)廣大電子設(shè)計(jì)工程師的普遍歡迎，應(yīng)用日益廣泛。芯片集成度和速度的不斷提高使得各種數(shù)字信號(hào)處理算法的硬件高速實(shí)現(xiàn)成為可能。隨著各大廠商發(fā)布的越來越先進(jìn)的EDA 工具軟件，自動(dòng)化設(shè)計(jì)程度隨之提高。傳統(tǒng)的 FFT 使用軟件或DSP 實(shí)現(xiàn)。在高速處理的時(shí)候?qū)崟r(shí)性比較難滿足。因此使用FPGA實(shí)現(xiàn)FFT 算法能滿足現(xiàn)代的高速運(yùn)算要求。
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