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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>SoC設計鏈中的可配置IP

      SoC設計鏈中的可配置IP

      2009-12-14 | rar | 343 | 次下載 | 3積分

      資料介紹

      本文簡要介紹了SoC 設計鏈面臨的挑戰(zhàn)以及對可配置IP 提出的新的要求。重點分析了如何利用Improv 系統(tǒng)公司開發(fā)的VLIW架構(gòu)和包括Jazz DSP 平臺的工具套件進行快速、低成本、高性能的終端設計。
      關(guān)鍵詞：可配置IP；VLIW；Jazz；SoC
      1、引言
      隨著 IC 的生產(chǎn)成本持續(xù)上漲，消費類電子產(chǎn)品制造商不得不努力尋求多種方法以滿足價格上升的迫切要求同時提高自身的利潤空間。這些方法中至關(guān)重要的一點就是采用可配置IP，借助其靈活可變且可重復使用的平臺來降低總的生產(chǎn)成本。這就要求一個芯片就能支持多個產(chǎn)品，而且各系列芯片的生產(chǎn)通過一個基礎設計就能完成，快速而價廉。使用可配置IP，公司就可以借用自身無法
      擁有的第三方資源，以最經(jīng)濟實惠的方式獲取前沿技術(shù)和解決方案。Improv 公司從事可配置DSP
      IP 設計已達10 年之久，成功地為不同的市場需求提供硅驗證解決方案，幫助眾多公司確立了技術(shù)和上市時間方面的優(yōu)勢。
      可配置IP 要滿足設計師和制造商的需求就必須能夠最有效地融入SoC 設計鏈中。這也意味著該IP 至少應該滿足以下幾個要求：
      1) 擁有高效的軟件開發(fā)方法
      2) 擁有高效的自動化驗證方法
      3) 擁有高效的方法進行快速集成
      4) 在硬連線的成本和性能方面極具競爭優(yōu)勢
      5) 提供自動方法進行系列解決方案的配置
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