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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>陣列信號幅相一致性校正及FPGA實現(xiàn)

      陣列信號幅相一致性校正及FPGA實現(xiàn)

      2010-01-06 | rar | 220 | 次下載 | 3積分

      資料介紹

      文章針對陣列信號處理中的由于陣元接收機和陣元位置擾動造成幅相不一致問題
      提出了一種基于比較法的解決方案，并利用FPGA 加以實現(xiàn)。通過計算的位擴展保證校正精度，同時兼顧處理的實時性，同時將位置擾動帶來的相位誤差歸一化到單陣元進行相位校正，并且利用了LVDS 端口提高傳輸速率，提高了可實現(xiàn)性，通過仿真和試驗證明了其可行性。
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