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為了滿足對(duì)分?jǐn)?shù)階信號(hào)變換進(jìn)行實(shí)時(shí)計(jì)算的要求,提出一種基于Altera St ratix II FPGA 平臺(tái)的可重配置分?jǐn)?shù)階信號(hào)變換處理器的硬件實(shí)現(xiàn)方案. 根據(jù)角度分解的算法,設(shè)計(jì)了一種通用的硬件框架并實(shí)現(xiàn). 利用FPGA 的可重配置性,通過簡(jiǎn)單的參數(shù)調(diào)整可以實(shí)現(xiàn)各種不同的分?jǐn)?shù)階信號(hào)變換的功能. 實(shí)驗(yàn)表明本系統(tǒng)靈活性強(qiáng),為快速開發(fā)各種基于分?jǐn)?shù)階信號(hào)變換的實(shí)時(shí)系統(tǒng)提供了一個(gè)良好的平臺(tái).
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