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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA延時(shí)精確調(diào)整時(shí)序的方法

      FPGA延時(shí)精確調(diào)整時(shí)序的方法

      2015-02-03 | pdf | 1217KB | 次下載 | 免費(fèi)

      資料介紹

      通過(guò)FPGA( 現(xiàn)場(chǎng)可編程門陣列) 時(shí)序模型分析得出FPGA 門延時(shí)的方案，綜合利用FPGA 各種布局布線EDA工具，摸索出一套人工干預(yù)FPGA 布局布線的方法，使FPGA門延時(shí)能夠有效地用于時(shí)序調(diào)整，調(diào)整精度可達(dá)到納秒級(jí)。該方法具有不增加任何額外器件，成本低、高效方便的特點(diǎn)。
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