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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA設(shè)計(jì)驗(yàn)證關(guān)鍵要點(diǎn)

      FPGA設(shè)計(jì)驗(yàn)證關(guān)鍵要點(diǎn)

      2015-02-04 | doc | 183KB | 次下載 | 免費(fèi)

      資料介紹

      不同于ASIC設(shè)計(jì)，F(xiàn)PGA設(shè)計(jì)中的標(biāo)準(zhǔn)元件或客制化實(shí)作，一般欠缺大量的資源及準(zhǔn)備措施可用于設(shè)計(jì)驗(yàn)證。由于可以重新程式化元件，更多時(shí)候驗(yàn)證只是事后的想法。本文將探討在FPGA設(shè)計(jì)驗(yàn)證周期過程中使用的工具及技術(shù)，并逐一審視各項(xiàng)優(yōu)缺點(diǎn)。有效驗(yàn)證降低設(shè)計(jì)風(fēng)險(xiǎn)。
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