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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>用于Xilinx 7系列GTZ收發(fā)器的IBERT的詳細數(shù)據(jù)和資料說明

      用于Xilinx 7系列GTZ收發(fā)器的IBERT的詳細數(shù)據(jù)和資料說明

      2019-02-21 | rar | 0.21 MB | 次下載 | 免費

      資料介紹

      　　7系列FPGA GTZ收發(fā)器的可定制的Logicore?IP Chipscope?Pro集成誤碼率測試（IBert）內(nèi)核用于評估和監(jiān)控GTZ收發(fā)器。該核心包括在FPGA邏輯中實現(xiàn)的模式生成器和校驗器，以及對端口的訪問和GTZ收發(fā)器的動態(tài)重新配置端口屬性。還包括通信邏輯，允許通過JTAG對設計進行運行時訪問。根據(jù)客戶配置和本文檔中的描述，此核心可以用作獨立的或開放的設計。

      　　Ibert核心設計用于需要驗證或評估7系列FPGA GTZ收發(fā)器的任何應用。

      　　Ibert核心為7系列FPGA GTZ收發(fā)器提供了一個廣泛的物理介質(zhì)附件（PMA）評估和演示系列?？梢詤?shù)化地使用不同的GTZ收發(fā)器和時鐘拓撲結(jié)構(gòu)，也可以自定義ibret核心，以使用不同的線路速率、參考時鐘速率和邏輯寬度。每個所需的GTZ收發(fā)器都包含數(shù)據(jù)模式生成器和校驗器，提供了許多不同的偽隨機二進制序列（PRB）和要通過通道發(fā)送的時鐘模式。此外，可以通過與GTZ收發(fā)器的DRP端口通信的邏輯訪問GTZ收發(fā)器的配置和調(diào)整，以更改屬性設置，以及控制端口上的值的寄存器。在運行時，Chipscope Analyzer工具通過JTAG，使用作為Ibert核心一部分的xilinx電纜和專有邏輯與Ibert核心進行通信。

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