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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA數(shù)字邏輯電路的設(shè)計與分析的基礎(chǔ)知識和工程文件免費下載

      FPGA數(shù)字邏輯電路的設(shè)計與分析的基礎(chǔ)知識和工程文件免費下載

      2020-12-10 | rar | 0.31 MB | 次下載 | 免費

      資料介紹

      　　主要內(nèi)容：設(shè)計一個一位的全加器，從真值表開始，介紹門級實現(xiàn)，然后形成電路圖，對功能進行仿真驗證，最后再用行為級描述實現(xiàn)全加器功能，二者形成對比。把 Verilog 代碼，硬件電路，仿真波形三者對應(yīng)起來。

      　　1．明確輸入、輸出接口

      　　加法器：即實現(xiàn)A+B=SUM。全加器不僅考慮本位計算結(jié)果是否有進位Count，也要考慮上一位對本位的進位 Cin。如下圖所示：

      　　因此，一位全加器共有 3 個輸入，2 個輸出，如果把它封裝成一個模塊，就是下圖所表現(xiàn)的形式

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