資料介紹
時(shí)序分析時(shí)FPGA設(shè)計(jì)中永恒的話題,也是FPGA開發(fā)人員設(shè)計(jì)進(jìn)階的必由之路。慢慢來,先介紹時(shí)序分析中的一些基本概念。
1. 時(shí)鐘相關(guān)
時(shí)鐘的時(shí)序特性主要分為抖動(dòng)(Jitter)、偏移(Skew)、占空比失真(Duty Cycle Distortion)3點(diǎn)。對(duì)于低速設(shè)計(jì),基本不用考慮這些特征;對(duì)于高速設(shè)計(jì),由于時(shí)鐘本身的原因造成的時(shí)序問題很普遍,因此必須關(guān)注。
1. 時(shí)鐘抖動(dòng) (clock jitter)
理想的時(shí)鐘信號(hào)應(yīng)該是理想的方波,但是現(xiàn)實(shí)中的時(shí)鐘的邊沿變化不可能是瞬變的,它有個(gè) 從低到高 / 從高到低 的變化過程,如圖1所示。
常見的抖動(dòng)參數(shù)有3種:
周期抖動(dòng)(Period Jitter):
周期抖動(dòng)率(Period Jitter)測(cè)量時(shí)鐘輸出傳輸偏離其理想位置的最大偏離。Period Jitter代表周期差抖動(dòng)的上下邊界。
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