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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實(shí)現(xiàn)可選主元LU分解流水線算法的設(shè)計(jì)

      如何使用FPGA實(shí)現(xiàn)可選主元LU分解流水線算法的設(shè)計(jì)

      2021-03-31 | rar | 0.80 MB | 次下載 | 免費(fèi)

      資料介紹

      　　提出了一種可以進(jìn)行列主元選取的細(xì)粒度LU分解流水線算法并在現(xiàn)場(chǎng)編程門陣列（FPGA）上得到了實(shí)現(xiàn)。該算法可以在進(jìn)行列主元選取的同時(shí)，充分利用數(shù)據(jù)的重用性，以減少數(shù)據(jù)讀寫次數(shù)。對(duì)其中的關(guān)鍵運(yùn)算實(shí)現(xiàn)了細(xì)粒度全流水，提高了分解性能。與Celeron（R）3.07GHz通用處理器主機(jī)相比可以得到平均6到7倍的加速比。與其他在FPGA上實(shí)現(xiàn)的LU分解算法相比，該算法在占用相對(duì)較少資源和保持高分解效率的前提下提高了計(jì)算的精確度和穩(wěn)定性.

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