資料介紹
提出了一種基于FPGA實(shí)現(xiàn)的全并行結(jié)構(gòu)FFT設(shè)計(jì)方法,采用XILINX公司最新器件VirtexII Pro,用硬件描述語言VHDL和圖形輸入相結(jié)合的方法,在ISE6.1中完成設(shè)計(jì)的輸入、綜合、編譯及布局布線,并用ModelSim和Matlab對設(shè)計(jì)作了聯(lián)合仿真。結(jié)果表明,通過利用FPGA器件中大量的乘法器、邏輯單元及存儲器等硬件資源,采用全并行加流水結(jié)構(gòu),可在一個(gè)時(shí)鐘節(jié)拍內(nèi)完成32點(diǎn)FFT運(yùn)算的功能,設(shè)計(jì)最高運(yùn)算速度可達(dá)11 ns,可實(shí)現(xiàn)對高速A/D采樣數(shù)據(jù)的實(shí)時(shí)處理.
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