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      電子發(fā)燒友網(wǎng)>電子資料下載>C語言|源代碼>基于FPGA數(shù)字頻率計的設計

      基于FPGA數(shù)字頻率計的設計

      2017-08-04 | doc | 229KB | 次下載 | 1積分

      資料介紹

      數(shù)字頻率計設計要點，代碼（電子設計競賽編程、寫論文時可用）

      　　2 對FPGA數(shù)字頻率計的制作規(guī)劃

      　　2.1 設計的目的

      　　掌握VHDL語言的基本結構及編程思想，掌握數(shù)字頻率計的工作原理，掌握數(shù)字頻率計的VHDL語言編程方法。

      　　2.2 數(shù)字頻率計的基本原理

      　　數(shù)字頻率計的主要功能是測量周期信號的頻率。頻率是單位時間（ 1S ）內信號發(fā)生周期變化的次數(shù)。如果我們能在給定的 1S 時間內對信號波形計數(shù)，并將計數(shù)結果顯示出來，就能讀取被測信號的頻率。數(shù)字頻率計首先必須獲得相對穩(wěn)定與準確的時間，同時將被測信號轉換成幅度與波形均能被數(shù)字電路識別的脈沖信號，然后通過計數(shù)器計算這一段時間間隔內的脈沖個數(shù)，將其換算后顯示出來［3］。這就是數(shù)字頻率計的基本原理。
      基于FPGA數(shù)字頻率計的設計

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