資料介紹
“鎖相環(huán)”(PLL) 是現(xiàn)代通信系統(tǒng)的基本構(gòu)建模塊。PLL 通
常用在無線電接收機或發(fā)射機中,主要提供“本振”(LO) 功
能;也可用于時鐘信號分配和降噪,而且越來越多地用作高采
樣速率模數(shù) (A/D) 轉(zhuǎn)換的時鐘源。
隨著集成電路加工中功能器件的尺寸縮小,器件電源電壓也
呈下降趨勢,包括 PLL 和其它混合信號功能所用的電源。然
而,PLL 的關(guān)鍵元件——“壓控振蕩器”(VCO) 的實用技術(shù)
要求并未隨之大幅降低。許多高性能 VCO 設(shè)計仍然采用分
立電路來實施,可能要求高達(dá) 30 V 的電源電壓。這就給當(dāng)今
的 PLL 或 RF 系統(tǒng)設(shè)計師提出了挑戰(zhàn):低壓 PLL IC 如何與高
壓 VCO 實現(xiàn)接口。電平轉(zhuǎn)換接口通常利用有源濾波電路來實
施,這將在下文討論。
本文將分析說明 PLL 的基本原理,考察采用高壓 VCO 的 PLL
設(shè)計的當(dāng)前技術(shù)水平,討論典型架構(gòu)的利弊,并介紹高壓
VCO 的一些替代方案。
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