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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>基于EP2C5T144的四人搶答器設(shè)計(jì)論文

      基于EP2C5T144的四人搶答器設(shè)計(jì)論文

      2017-12-25 | doc | 838KB | 次下載 | 免費(fèi)

      資料介紹

      　本文介紹了以FPGA為基礎(chǔ)的四路搶答器的設(shè)計(jì)，此次設(shè)計(jì)是一個(gè)有4組搶答輸入，并具有搶答計(jì)時(shí)控制，按鍵消抖以及積分顯示等功能的通用型搶答器。主持人有4個(gè)按鍵控制，可以進(jìn)行開始搶答，對(duì)各搶答小組成績(jī)進(jìn)行相應(yīng)加減操作以及所有積分重置。此次設(shè)計(jì)程序使用verilog語言編寫，并且使用modelsim進(jìn)行相關(guān)仿真，最后在FPGA開發(fā)板上燒錄程序進(jìn)行實(shí)際操作演示實(shí)現(xiàn)了相應(yīng)功能，達(dá)到了此次設(shè)計(jì)的目的。本設(shè)計(jì)采用FPGA來做增強(qiáng)了時(shí)序控制的靈活性，同時(shí)由于FPGA的IO端口資源豐富，可以再本設(shè)計(jì)基礎(chǔ)上稍加修改可以重復(fù)設(shè)計(jì)出具有多組輸入的搶答器。
      基于EP2C5T144的四人搶答器設(shè)計(jì)論文
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