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an external clock which may be part of the
system in which this one-shot is to work. As
shown in Figures 1 and 3 the PLD is
configured to have a latch and an eight-bit
binary up counter which is presettable by
input data to any number less than 256.
Since the input data is inverted before it is
loaded into the registers, counting from the
complements of the input to FF will give the
correct number of counts as counting from
the input down to 00.
an external clock which may be part of the
system in which this one-shot is to work. As
shown in Figures 1 and 3 the PLD is
configured to have a latch and an eight-bit
binary up counter which is presettable by
input data to any number less than 256.
Since the input data is inverted before it is
loaded into the registers, counting from the
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correct number of counts as counting from
the input down to 00.
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